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提出了一種將部分傳輸序列與遞歸最小二乘法相結(jié)合的OFDM非線性失真自適應(yīng)補(bǔ)償技術(shù)。利用部分傳輸序列降低OFDM信號(hào)的峰均比；使用遞歸最小二乘法擬合高功率放大器的幅度/幅度和幅度/相位特性曲線，對(duì)OFDM信號(hào)進(jìn)行預(yù)失真處理，以補(bǔ)償系統(tǒng)的非線性失真。仿真結(jié)果表明，所提出的方法收斂速度快，能對(duì)高功率放大器引入的非線性失真進(jìn)行有效的補(bǔ)償。
標(biāo)簽： OFDM 非線性失真 補(bǔ)償技術(shù)
上傳時(shí)間： 2013-11-15
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用二端口S-參數(shù)來(lái)表征差分電路的特性■ Sam Belkin差分電路結(jié)構(gòu)因其更好的增益，二階線性度，突出的抗雜散響應(yīng)以及抗躁聲性能而越來(lái)越多地被人們采用。這種電路結(jié)構(gòu)通常需要一個(gè)與單端電路相連接的界面，而這個(gè)界面常常是采用“巴倫”器件（Balun），這種巴倫器件提供了平衡結(jié)構(gòu)-到-不平衡結(jié)構(gòu)的轉(zhuǎn)換功能。要通過(guò)直接測(cè)量的方式來(lái)表征平衡電路特性的話，通常需要使用昂貴的四端口矢量網(wǎng)絡(luò)分析儀。射頻應(yīng)用工程師還需要確定幅值和相位的不平衡是如何影響差分電路性能的。遺憾的是，在射頻技術(shù)文獻(xiàn)中，很難找到一種能表征電路特性以及衡量不平衡結(jié)構(gòu)所產(chǎn)生影響的好的評(píng)估方法。這篇文章的目的就是要幫助射頻應(yīng)用工程師們通過(guò)使用常規(guī)的單端二端口矢量網(wǎng)絡(luò)分析儀來(lái)準(zhǔn)確可靠地解決作為他們?nèi)粘９ぷ鞯牟罘蛛娐诽匦缘臏y(cè)量問(wèn)題。本文介紹了一些用來(lái)表征差分電路特性的實(shí)用和有效的方法， 特別是差分電壓，共模抑制（CMRR），插入損耗以及基于二端口S-參數(shù)的差分阻抗。差分和共模信號(hào)在差分電路中有兩種主要的信號(hào)類型：差分模式或差分電壓Vdiff 和共模電壓Vcm（見圖2）。它們各自的定義如下[1]：• 差分信號(hào)是施加在平衡的3 端子系統(tǒng)中未接地的兩個(gè)端子之上的• 共模信號(hào)是相等地施加在平衡放大器或其它差分器件的未接地的端子之上。
上傳時(shí)間： 2013-10-14
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以嵌入式ARM9控制器LPC3250為核心，并采用同時(shí)采樣A/D轉(zhuǎn)換器，設(shè)計(jì)了手持式三相不平衡度測(cè)試儀。可以同時(shí)測(cè)量8路交流信號(hào)的有效值、相位及三相電壓電流的序量和不平衡度，且具有良好的人機(jī)界面。系統(tǒng)通過(guò)提高采樣率并引入全相位FFT算法，可大幅提高幅值與相位測(cè)量精度，從而提高不平衡度的測(cè)量精度。系統(tǒng)可以將被測(cè)參數(shù)、趨勢(shì)值、波形數(shù)據(jù)等存入SD卡，并通過(guò)網(wǎng)絡(luò)接口實(shí)現(xiàn)遠(yuǎn)端通信，從而實(shí)現(xiàn)遠(yuǎn)程監(jiān)控。
標(biāo)簽： ARM9 三相 不平衡 試儀設(shè)計(jì)
上傳時(shí)間： 2013-11-19
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第1章 集成運(yùn)放應(yīng)用電路設(shè)計(jì)須知 1.1 集成運(yùn)放簡(jiǎn)介 1.1.1 集成運(yùn)放的內(nèi)部框圖、分類和圖形符號(hào) 1.1.2 集成運(yùn)放的引腳功能、封裝及命名方法 1.1.3 集成運(yùn)放的參數(shù) 1.2 理想運(yùn)算放大器 1.2.1 運(yùn)放的理想?yún)?shù)及理想運(yùn)放的電路模型 1.2.2 簡(jiǎn)化設(shè)計(jì)的基本準(zhǔn)則 1.3 選擇電阻器須知 1.3.1 電阻器系列及溫度系數(shù) 1.3.2 常用電阻器的結(jié)構(gòu)與特點(diǎn)及參數(shù) 1.4 選用電容器須知 1.4.1 電容器容量系列、損耗及絕緣電阻 1.4.2 常用電容器的類型、特點(diǎn)及規(guī)格 1.5 集成運(yùn)放的電源 1.5.1 集成運(yùn)放電源的選擇 1.5.2 各類電源系列 1.5.3 集成運(yùn)放電源使用注意事項(xiàng) 第2章 集成運(yùn)放調(diào)零、相位補(bǔ)償與保護(hù)電路的設(shè)計(jì) 2.1 偏置電流補(bǔ)償電路及調(diào)零電路的設(shè)計(jì) 2.1.1 偏置電流補(bǔ)償電路的設(shè)計(jì) 2.1.2 調(diào)零電路的設(shè)計(jì)
標(biāo)簽： 360 集成運(yùn)放 應(yīng)用電路
上傳時(shí)間： 2013-10-09
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附件是一款PCB阻抗匹配計(jì)算工具，點(diǎn)擊CITS25.exe直接打開使用，無(wú)需安裝。附件還帶有PCB連板的一些計(jì)算方法，連板的排法和PCB聯(lián)板的設(shè)計(jì)驗(yàn)驗(yàn)。 PCB設(shè)計(jì)的經(jīng)驗(yàn)建議: 1.一般連板長(zhǎng)寬比率為1：1~2.5：1,同時(shí)注意For FuJi Machine:a.最大進(jìn)板尺寸為:450*350mm, 2.針對(duì)有金手指的部分,板邊處需作掏空處理,建議不作為連板的部位. 3.連板方向以同一方向?yàn)閮?yōu)先,考量對(duì)稱防呆,特殊情況另作處理. 4.連板掏空長(zhǎng)度超過(guò)板長(zhǎng)度的1/2時(shí),需加補(bǔ)強(qiáng)邊. 5.陰陽(yáng)板的設(shè)計(jì)需作特殊考量. 6.工藝邊需根據(jù)實(shí)際需要作設(shè)計(jì)調(diào)整,軌道邊一般不少於6mm,實(shí)際中需考量板邊零件的排布,軌道設(shè)備正常卡壓距離為不少於3mm,及符合實(shí)際要求下的連板經(jīng)濟(jì)性. 7.FIDUCIAL MARK或稱光學(xué)定位點(diǎn),一般設(shè)計(jì)在對(duì)角處,為2個(gè)或4個(gè),同時(shí)MARK點(diǎn)面需平整,無(wú)氧化,脫落現(xiàn)象;定位孔設(shè)計(jì)在板邊,為對(duì)稱設(shè)計(jì),一般為4個(gè),直徑為3mm,公差為±0.01inch. 8.V-cut深度需根據(jù)連板大小及基板板厚考量,角度建議為不少於45°. 9.連板設(shè)計(jì)的同時(shí),需基於基板的分板方式考量<人工(治具)還是使用分板設(shè)備>. 10.使用針孔(郵票孔)聯(lián)接：需請(qǐng)考慮斷裂后的毛刺,及是否影響COB工序的Bonding機(jī)上的夾具穩(wěn)定工作,還應(yīng)考慮是否有無(wú)影響插件過(guò)軌道,及是否影響裝配組裝.
標(biāo)簽： PCB 阻抗匹配 計(jì)算工具 教程
上傳時(shí)間： 2014-12-31
上傳用戶：sunshine1402
DesignSpark PCB 第3版現(xiàn)已推出! 包括3種全新功能: 1. 模擬介面 Simulation Interface 2. 設(shè)計(jì)計(jì)算機(jī) Design Calculator 3. 零件群組 Component Grouping 第3版新功能介紹 (含資料下載) 另外, 中文版的教學(xué)已經(jīng)準(zhǔn)備好了, 備有簡(jiǎn)體和繁體版, 趕快下載來(lái)看看! 設(shè)計(jì)PCB產(chǎn)品激活：激活入品 Lorem ipsum dolor sit amet, consectetur adipisicing elit, sed do eiusmod tempor incididunt ut labore et dolore magna aliqua. Ut enim ad minim veniam, quis nostrud exercitation ullamco laboris nisi ut aliquip ex ea commodo consequat. Duis aute irure dolor in reprehenderit in voluptate velit esse cillum dolore eu fugiat nulla pariatur. Excepteur sint occaecat cupidatat non proident, sunt in culpa qui officia deserunt mollit anim id est laborum。
標(biāo)簽： DesignSpark PCB 設(shè)計(jì)工具 免費(fèi)下載
上傳時(shí)間： 2013-10-19
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標(biāo)簽： DesignSpark PCB 設(shè)計(jì)工具 免費(fèi)下載
上傳時(shí)間： 2013-10-07
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在數(shù)字濾波器中，F(xiàn)IR濾波器是一種結(jié)構(gòu)簡(jiǎn)單且總是穩(wěn)定的濾波器，同時(shí)也只有FIR濾波器擁有線性相位的特性。傳統(tǒng)的直接型濾波器運(yùn)算速度過(guò)慢，而改進(jìn)型的DA結(jié)構(gòu)的濾波器需要過(guò)高的芯片面積消耗大量的邏輯資源很難達(dá)到運(yùn)算速度以及邏輯資源節(jié)約的整體優(yōu)化。本文提出了一種基于RAG算法的FIR濾波器，與傳統(tǒng)的基于DA算法的濾波器結(jié)構(gòu)的濾波器相比，RAG算法簡(jiǎn)化了FIR濾波器乘法模塊的結(jié)構(gòu)，減少了邏輯資源的消耗和硬件實(shí)現(xiàn)面積，提高了計(jì)算速度。本文設(shè)計(jì)的16階FIR濾波器用VerilogHDL進(jìn)行描述，并綜合到Altera公司的CycloneⅡ系列FPGA中。仿真實(shí)驗(yàn)表明基于RAG算法的FIR濾波器達(dá)到了邏輯資源的節(jié)約和運(yùn)算速度的提高的整體優(yōu)化效果。
標(biāo)簽： FPGA FIR 濾波器 優(yōu)化算法
上傳時(shí)間： 2014-01-02
上傳用戶：waizhang
設(shè)計(jì)采用Altera公司CycloneII系列EP2C5Q208作為核心器件，采用直接數(shù)字頻率合成技術(shù)實(shí)現(xiàn)了一個(gè)頻率、相位可控的基本信號(hào)發(fā)生器。該信號(hào)發(fā)生器可以產(chǎn)生正弦波、方波、三角波和鋸齒波四種波形。仿真及硬件驗(yàn)證的結(jié)果表明，該信號(hào)發(fā)生器精度高，抗干擾性好，此設(shè)計(jì)方案具有一定的實(shí)用性。
標(biāo)簽： FPGA DDS 波形 信號(hào)發(fā)生器
上傳時(shí)間： 2013-12-18
上傳用戶：kz_zank
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