DDS在現在運用月來越廣泛，在相對帶寬、頻率轉換時間、相位連續性、正交輸出、高分辨力以及集成化等方面都遠遠超過了傳統頻率合成技術所能達到的水平，為系統提供了優于模擬信號源的性能。利用DDS技術可以很方便地實現多種信號。在FPGA上實現的DDS
標簽： DDS
上傳時間： 2013-12-18
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關于simu1: 在simlink運行之前的初始化過程中，完成了信道時延和幅度的估計，多徑合成權系數估計 多徑合成采用可選EG/MR/MMSE合成 信道可選白噪聲信道AWGN和IEEE80.215.3a UWB標準信道模型(CM1-CM4)但為了簡化， 這里采用了IEEE80.215.3a給出了信道模型中的仿真數據包(如果你是作超寬帶的，信道模型程序和數據可從IEEE80.215.3a網站獲取) 和大部分仿真一樣，模型中的Eb/No指的是單比特信息符號攜帶的能量和噪聲的比例，監督的講，在AWGN信道中，Eb/No為4.31db時,誤碼率0.01 關于zslsimu直接運行simuuwb.m可看到結果) 顯然和simu1一樣，只是增加了.m文件，修改.m文件中的重要參數:多徑數、PN序列長度、PN序列、單個信息碼元寬度Tb(單位ns)、每個脈沖寬度Tc(單位ns)、系統的仿真精度Ts(單位ns)、仿真時間 chanidx=1:1是因為考慮信道數據文件太大，不好上傳，想得到精確的仿真，同一個信道類型(chantype)，最好仿真100次實現，信道文件可由UWB標準組織下載
上傳時間： 2015-08-14
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有關matlab的自適應濾波設計，有波束形成理論
上傳時間： 2015-08-26
上傳用戶：蠢蠢66
利用瀏覽器隱藏圖片 運行環境：XPSP2+IE6.0和TT；VC++ 6.0 注意事項：工程壓縮包中的convert\Release\convert.exe是示例程序。 在這個目錄中有兩個BMP文件，其中2.bmp是經過我用PhotoShop處理過的，用來做隱藏文件。1.bmp是正常顯示的文件。 運行程序后選擇輸出的圖片名若為3.bmp，直接雙擊a.htm就可以測試合成文件。否則需要修改a.htm中的文件名。
標簽： convertReleaseconvert 6.0 XPSP BMP
上傳時間： 2015-08-29
上傳用戶：hn891122
一個自由、開源的圖形庫--FreeImage3.92最新版的中文參考(支持位圖構件―例如調色板和數據位―的便易訪問；將位圖從一種位深度轉換到另一種位深度；當有多幅位圖頁―例如TIFF―時訪問位圖的不同頁；基本的位圖處理，如旋轉、翻轉（flipping）和重采樣，或點操作，如亮度和對比度調整；Alpha混合與合成（Compositing and blending）；FreeImage不支持：高級圖象處理操作，如回卷（Convolution）和變換（Transform）；位圖繪制； 矢量圖形。)
上傳時間： 2014-12-03
上傳用戶：lacsx
2006altera大賽－基于軟核Nios的寬譜正弦信號發生器設計：摘要：本設計運用了基于 Nios II 嵌入式處理器的 SOPC 技術。系統以 ALTERA公司的 Cyclone 系列 FPGA 為數字平臺，將微處理器、總線、數字頻率合成器、存儲器和 I/O 接口等硬件設備集中在一片 FPGA 上，利用直接數字頻率合成技術、數字調制技術實現所要求波形的產生，用 FPGA 中的 ROM 儲存 DDS 所需的波形表，充分利用片上資源，提高了系統的精確度、穩定性和抗干擾性能。使用新的數字信號處理（DSP）技術，通過在 Nios 中軟件編程解決 不同的調制方式的實現和選擇。系統頻率實現 1Hz～20MHz 可調，步進達到了1Hz；完成了調幅、調頻、二進制 PSK、二進制 ASK、二進制 FSK 調制和掃頻輸出的功能。
標簽： Nios Cyclone altera ALTERA
上傳時間： 2015-09-02
上傳用戶：coeus
SMIL 手冊及其MMS 應用指南,含有例子.同步多媒體集成語言(SMIL [1])是基于XML 的語言，它可用于創建多媒體顯示程序。SMIL 能 夠根據在屏幕上以及時間坐標軸上給出元素的位置，將不同媒體元素，例如圖象、聲頻、視頻和文本等合成到顯示之中。
上傳時間： 2014-01-11
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mvdr,程序，希望對大家學習水聲中的波束形成有用啊
上傳時間： 2015-09-25
上傳用戶：coeus
51單片機控制FPGA，通過DDS方式合成波形的發生器控制程序
上傳時間： 2014-01-05
上傳用戶：semi1981
此程序采用數據并行方式 //每個處理器執行相同的可視化流程: // vtkImageReader -> vtkContourFilter -> vtkElevationFilter //另外,第一個處理器創建n個輸入接口(n=處理器個數-1),同時其它處理器 //分別創建輸出接口與其對應.第一個處理器合成自己和其它處理器輸出的 //多邊形數據,并將其顯示出來.
標簽： vtkElevationFilter vtkContourFilter vtkImageReader gt
上傳時間： 2015-10-13
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