電子功能模件是機(jī)電產(chǎn)品的基本組成部分，其水平高低直接決定整個(gè)機(jī)電產(chǎn)品的工作質(zhì)量。當(dāng)前PCB自動(dòng)測(cè)試系統(tǒng)大多為歐美產(chǎn)品，價(jià)格相當(dāng)昂貴，遠(yuǎn)遠(yuǎn)超出我國(guó)中小電子企業(yè)的承受能力。為了提高我國(guó)中小企業(yè)電子設(shè)備的競(jìng)爭(zhēng)力，本課題研發(fā)了適合于我國(guó)中小企業(yè)、價(jià)格低廉、使用方便的PCB路內(nèi)測(cè)試系統(tǒng)。 本文首先詳細(xì)介紹了PCB各種檢測(cè)技術(shù)的原理和特點(diǎn)，然后根據(jù)本課題面向的用戶(hù)群和他們對(duì)PCB測(cè)試的需求，組建PCB內(nèi)測(cè)試系統(tǒng)。本系統(tǒng)基于虛擬儀器設(shè)計(jì)思想，以PCB上模擬電子器件、組合邏輯電路及由其構(gòu)成的功能模塊等為被測(cè)對(duì)象，包括路內(nèi)測(cè)試儀、邏輯分析單元、信號(hào)發(fā)生器、高速數(shù)據(jù)采集器、多路通道掃描器及針床。其中：路內(nèi)測(cè)試儀對(duì)不同被測(cè)對(duì)象選擇不同測(cè)試方法，采用電位隔離法實(shí)現(xiàn)了被測(cè)對(duì)象與PCB上其他元器件的隔離，并采用自適應(yīng)測(cè)試方法提高測(cè)試結(jié)果的準(zhǔn)確度。邏輯分析單元主要采用反向驅(qū)動(dòng)技術(shù)測(cè)試常見(jiàn)的組合邏輯電路。信號(hào)發(fā)生器能同時(shí)產(chǎn)生兩路正弦波、方波、斜波、三角波等常用波形。數(shù)據(jù)采集器能同時(shí)采集四路信號(hào)，以USB接口與主機(jī)通訊。多路通道掃描器采用小型繼電器陣列來(lái)實(shí)現(xiàn)，可擴(kuò)展性好。針床采用新型夾具，既保證接觸性能，又不至破壞觸點(diǎn)。 實(shí)踐表明，本系統(tǒng)能對(duì)常用電子功能模件進(jìn)行自動(dòng)測(cè)試，基本達(dá)到了預(yù)期目標(biāo)。
標(biāo)簽： PCB 故障診斷 測(cè)試系統(tǒng)
上傳時(shí)間： 2013-06-06
上傳用戶(hù)：klds
實(shí)用1KHZ標(biāo)準(zhǔn)正弦信號(hào)發(fā)生電路-本電路簡(jiǎn)潔，信號(hào)失真度小。輸出電壓可調(diào)。已在功放測(cè)試儀上大批使用。
標(biāo)簽： 1KHZ 標(biāo)準(zhǔn) 發(fā)生電路
上傳時(shí)間： 2013-06-28
上傳用戶(hù)：Killerboo
任意波形發(fā)生器已成為現(xiàn)代測(cè)試領(lǐng)域應(yīng)用最為廣泛的通用儀器之一，代表了信號(hào)源的發(fā)展方向。直接數(shù)字頻率合成(DDS)是二十世紀(jì)七十年代初提出的一種全數(shù)字的頻率合成技術(shù)，其查表合成波形的方法可以滿足產(chǎn)生任意波形的要求。由于現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)具有高集成度、高速度、可實(shí)現(xiàn)大容量存儲(chǔ)器功能的特性，能有效地實(shí)現(xiàn)DDS技術(shù)，極大的提高函數(shù)發(fā)生器的性能，降低生產(chǎn)成本。 本文首先介紹了函數(shù)波形發(fā)生器的研究背景和DDS的理論。然后詳盡地?cái)⑹隽擞肍PGA完成DDS模塊的設(shè)計(jì)過(guò)程，接著分析了整個(gè)設(shè)計(jì)中應(yīng)處理的問(wèn)題，根據(jù)設(shè)計(jì)原理就功能上進(jìn)行了劃分，將整個(gè)儀器功能劃分為控制模塊、外圍硬件、FPGA器件三個(gè)部分來(lái)實(shí)現(xiàn)。最后就這三個(gè)部分分別詳細(xì)地進(jìn)行了闡述。 在實(shí)現(xiàn)過(guò)程中，本設(shè)計(jì)選用了Altera公司的EP2C35F672C6芯片作為產(chǎn)生波形數(shù)據(jù)的主芯片，充分利用了該芯片的超大集成性和快速性。在控制芯片上選用了三星公司的上S3C2440作為控制芯片。本設(shè)計(jì)中，F(xiàn)PGA芯片的設(shè)計(jì)和與控制芯片的接口設(shè)計(jì)是一個(gè)難點(diǎn)，本文利用Altera的設(shè)計(jì)工具QuartusⅡ并結(jié)合Verilog—HDL語(yǔ)言，采用硬件編程的方法很好地解決了這一問(wèn)題。論文最后給出了系統(tǒng)的測(cè)量結(jié)果，并對(duì)誤差進(jìn)行了一定分析，結(jié)果表明，可輸出步進(jìn)為0.01Hz，頻率范圍0.01Hz～20MHz的正弦波、三角波、鋸齒波、方波，或0.01Hz～20KHz的任意波。通過(guò)實(shí)驗(yàn)結(jié)果表明，本設(shè)計(jì)達(dá)到了預(yù)定的要求，并證明了采用軟硬件結(jié)合，利用FPGA技術(shù)實(shí)現(xiàn)任意波形發(fā)生器的方法是可行的。
標(biāo)簽： FPGA 函數(shù)信號(hào)發(fā)生器
上傳時(shí)間： 2013-08-03
上傳用戶(hù)：1079836864
隨著科學(xué)技術(shù)的飛速發(fā)展，電子測(cè)量技術(shù)被廣泛應(yīng)用在電子、機(jī)械、醫(yī)療、測(cè)控及航天等各個(gè)領(lǐng)域，而電子測(cè)量技術(shù)要用到各種形式的高質(zhì)量信號(hào)源，因此任意波形發(fā)生器的研制就具有非常重要的現(xiàn)實(shí)意義。 本文便是基于DDS(DirectDigitalSynthesis)技術(shù)進(jìn)行任意波形發(fā)生器研制的。要求可以產(chǎn)生正弦波、方波、三角波與鋸齒波等常規(guī)波形，而且能夠產(chǎn)生任意波形，從而滿足研究的需要。具體工作如下： (一)介紹國(guó)內(nèi)外關(guān)于任意波形發(fā)生器研究的發(fā)展情況，闡述頻率合成技術(shù)的各種方式與技術(shù)對(duì)比情況，并選定直接數(shù)字頻率合成技術(shù)進(jìn)行研制。 (二)介紹系統(tǒng)的硬件設(shè)計(jì)構(gòu)成與功能實(shí)現(xiàn)，并對(duì)系統(tǒng)部件進(jìn)行逐一細(xì)述。選用單片機(jī)作為控制模塊，使用FPGA實(shí)現(xiàn)DDS功能作為技術(shù)核心，并對(duì)外圍電路的設(shè)計(jì)與接口技術(shù)進(jìn)行分析。 (三)講述DDS的工作原理、工作特點(diǎn)與技術(shù)指標(biāo)，并基于FPGA芯片EP1C3T144C8進(jìn)行設(shè)計(jì)，通過(guò)使用相位累加器與波形ROM等模塊，實(shí)現(xiàn)DDS功能。同時(shí)輔以使能模塊與行列式鍵盤(pán)，實(shí)現(xiàn)各種波形的靈活輸出。 (四)給出系統(tǒng)產(chǎn)生的測(cè)試數(shù)據(jù)，并對(duì)影響頻譜純度的雜散與噪聲產(chǎn)生的原因進(jìn)行分析。
標(biāo)簽： FPGA 任意波形發(fā)生器
上傳時(shí)間： 2013-04-24
上傳用戶(hù)：diets
由可編程器件控制的信號(hào)發(fā)生器可輸出正弦波、方波、鋸齒波，其頻率可調(diào)。能輸出正 弦波、方波、鋸齒波的組合波形，且組合波形的頻率可調(diào)。還能輸出占空比和頻率可調(diào)的方 波。
標(biāo)簽： 信號(hào)發(fā)生器
上傳時(shí)間： 2013-05-28
上傳用戶(hù)：躍躍，，
移動(dòng)無(wú)線信道特性對(duì)移動(dòng)通信系統(tǒng)性能具有重要影響，移動(dòng)信道建模和仿真對(duì)移動(dòng)通信系統(tǒng)的研發(fā)具有重要意義。因此，對(duì)移動(dòng)信道建模與仿真進(jìn)行研究，具有重要的理論意義和實(shí)際應(yīng)用價(jià)值。 本文從無(wú)線電波的傳播特點(diǎn)出發(fā)，分析了無(wú)線電波的傳播模型和描述信道特性的主要參數(shù)，重點(diǎn)分析了移動(dòng)小尺度衰落模型；結(jié)合無(wú)線電波傳輸環(huán)境的特點(diǎn)，研究了平坦衰落信道和頻率選擇性信道的特點(diǎn)，設(shè)計(jì)了基于FPGA的移動(dòng)無(wú)線信道仿真器，同時(shí)給予了軟硬件驗(yàn)證。 本文從衰落的數(shù)學(xué)模型角度研究了信道傳輸特性，以及各項(xiàng)參數(shù)對(duì)信道特性的影響。主要做了以下幾個(gè)方面的工作： 1.簡(jiǎn)要介紹了無(wú)線電通信的發(fā)展史及信道建模與仿真的意義；論述了信道對(duì)無(wú)線信號(hào)主要的三類(lèi)影響：自由空間的路徑損失、陰影衰落、多徑衰落；分析了無(wú)線通信傳播環(huán)境，移動(dòng)無(wú)線通信信道仿真的基本模型，同時(shí)介紹了用正弦波疊加法和成型濾波器法建立信道確定型仿真模型的具體實(shí)現(xiàn)方法。 2.對(duì)移動(dòng)無(wú)線信道特性進(jìn)行了Matlab仿真，對(duì)仿真結(jié)果進(jìn)行了對(duì)比分析，對(duì)影響信道特性的主要參數(shù)設(shè)置進(jìn)行了分析仿真。 3.設(shè)計(jì)了一種基于FPGA的移動(dòng)無(wú)線信道仿真器，并對(duì)實(shí)現(xiàn)該仿真器的關(guān)鍵技術(shù)和實(shí)現(xiàn)方法進(jìn)行了分析。該信道仿真器能夠?qū)崟r(shí)模擬窄帶信號(hào)條件下無(wú)線信道的主要特點(diǎn)，如多徑時(shí)延、多普勒頻移、瑞利衰落等，其主要的技術(shù)指標(biāo)達(dá)到了設(shè)計(jì)要求。該模擬器結(jié)構(gòu)簡(jiǎn)單，參數(shù)可調(diào)，易于擴(kuò)展，通用性強(qiáng)，可以部分或全部集成到處于研制階段的接收機(jī)中，以便于性能測(cè)試，也可應(yīng)用于教學(xué)實(shí)踐。
標(biāo)簽： FPGA 移動(dòng) 無(wú)線信道
上傳時(shí)間： 2013-04-24
上傳用戶(hù)：suxuan110425
本文提出了一種基于SOPC 片上可編程的全數(shù)字化步進(jìn)電機(jī)控制系統(tǒng)，本系統(tǒng)是以 FPGA 為核心控制器件，將驅(qū)動(dòng)邏輯功能模塊和控制器成功地集成在FPGA 上實(shí)現(xiàn)，充分 發(fā)揮了硬件邏輯電路對(duì)數(shù)字信號(hào)高速的并行處理能力，可以使步進(jìn)電機(jī)繞組電流細(xì)分達(dá)到 4096，且細(xì)分?jǐn)?shù)可以自動(dòng)調(diào)節(jié)，極大地提高了控制精度和驅(qū)動(dòng)器的集成度，減小了驅(qū)動(dòng)器 體積。
標(biāo)簽： FPGA 步進(jìn)電機(jī) 正弦波
上傳時(shí)間： 2013-05-21
上傳用戶(hù)：pei5
JPEG 2000是為適應(yīng)不斷發(fā)展的圖像壓縮應(yīng)用而出現(xiàn)的新的靜止圖像壓縮標(biāo)準(zhǔn)，小波變換是JEPG 2000核心算法之一。小波變換是一種可達(dá)到時(shí)(空)域或頻率域局部化的時(shí)頻域或空頻域分析方法，其多尺度分解特性符合人類(lèi)的視覺(jué)機(jī)制，更加適用于圖像信息的處理。提升小波變換是一類(lèi)不采用傅立葉變換做為主要分析工具的小波變換新方法，提升小波變換的提出大大簡(jiǎn)化了小波變換的計(jì)算，使其在實(shí)時(shí)信號(hào)處理領(lǐng)域得到廣泛的應(yīng)用。通過(guò)提升的方法很容易構(gòu)造一般的整數(shù)小波變換，由于圖像一般用位數(shù)較低的整數(shù)表示，整數(shù)小波變換可以將為整數(shù)序列的圖像矩陣映射成整數(shù)小波系數(shù)矩陣，這就大大簡(jiǎn)化了小波變換的硬件電路設(shè)計(jì)。在當(dāng)今數(shù)字化和信息化時(shí)代背景下，研究具有高速硬件處理功能的可變程邏輯器件在圖像壓縮算法領(lǐng)域的應(yīng)用已經(jīng)成為當(dāng)今研究的熱點(diǎn)。 本文旨在探討和研制基于FPGA的小波變換模塊的可能性和方法。本文采用Xilinx公司的Spartan-Ⅲ系列芯片，根據(jù)JPEG 2000推薦無(wú)損提升小波算法和有損提升小波算法，設(shè)計(jì)圖像壓縮系統(tǒng)的小波變換模塊。主要工作如下： 第一部分介紹了傳統(tǒng)小波分析理論和提升小波分析理論。包括連續(xù)小波時(shí)頻局域性的特征，離散小波變換系數(shù)的意義，多分辨分析引出的構(gòu)造小波基的系統(tǒng)方法和計(jì)算離散小波的快速算法等。重點(diǎn)放在介紹正交小波和雙正交小波的構(gòu)造方法，并介紹了數(shù)字圖像在小波域的特點(diǎn)。討論了提升小波變換的基本思想，討論了用提升方法構(gòu)造小波基以及傳統(tǒng)小波變換的提升實(shí)現(xiàn)，討論了整數(shù)小波變換。 第二部分介紹了FPGA結(jié)構(gòu)及其設(shè)計(jì)流程。介紹了FPGA/CPLD器件的特征、發(fā)展趨勢(shì)及FPGA/CPLD基本結(jié)構(gòu)，然后重點(diǎn)介紹了本文用到的Xilinx公司Spartan-Ⅲ系列芯片的結(jié)構(gòu)特點(diǎn)，以及Xilinx的FPGA開(kāi)發(fā)軟件ISE，最后介紹了硬件描述語(yǔ)言VHDL語(yǔ)言的特點(diǎn)。 最后一部分是本論文研究的主要內(nèi)容，即JPEG 2000中最核心的算法-提升格式小波變換的一維變換模塊設(shè)計(jì)和二維變換模塊設(shè)計(jì)。一維提升小波變換模塊采用兩種不同的電路結(jié)構(gòu)進(jìn)行設(shè)計(jì)-低速低功耗的串行流水線結(jié)構(gòu)和高速高功耗的并行陣列結(jié)構(gòu)。同樣，二維小波變換模塊也采用了兩種不同的電路結(jié)構(gòu)進(jìn)行設(shè)計(jì)-低速低功耗的折疊結(jié)構(gòu)和高速高功耗的串行結(jié)構(gòu)。 文章對(duì)提升小波變換的FPGA實(shí)現(xiàn)中的大量細(xì)節(jié)問(wèn)題進(jìn)行了討論，給出了每種結(jié)構(gòu)提升小波變換模塊的電路原理圖，并對(duì)原理圖進(jìn)行了仿真測(cè)試，仿真測(cè)試結(jié)果不僅表明了模塊功能的正確性，而且表明不同小波模塊可以滿足相應(yīng)領(lǐng)域的實(shí)際要求。
上傳時(shí)間： 2013-06-08
上傳用戶(hù)：dwzjt
頻率合成技術(shù)廣泛應(yīng)用于通信、航空航天、儀器儀表等領(lǐng)域，目前，常用的頻率合成技術(shù)有直接頻率合成、鎖相頻率合成和直接數(shù)字頻率合成(DDS)等。其中DDS是一種新的頻率合成方法，是頻率合成的一次革命。全數(shù)字化的DDS技術(shù)由于具有頻率分辨率高、頻率切換速度快、相位噪聲低和頻率穩(wěn)定度高等優(yōu)點(diǎn)而成為現(xiàn)代頻率合成技術(shù)中的佼佼者。隨著數(shù)字集成電路、微電子技術(shù)和EDA技術(shù)的深入研究，DDS技術(shù)得到了飛速的發(fā)展。 DDS是把一系列數(shù)字量化形式的信號(hào)通過(guò)D/A轉(zhuǎn)換形成模擬量形式的信號(hào)的合成技術(shù)。主要是利用高速存儲(chǔ)器作查尋表，然后通過(guò)高速D/A轉(zhuǎn)換產(chǎn)生已經(jīng)用數(shù)字形式存入的正弦波(或其它任意波形)。一個(gè)典型的DDS系統(tǒng)應(yīng)包括以下三個(gè)部分：相位累加器可以時(shí)鐘的控制下完成相位的累加；相位一幅度碼轉(zhuǎn)換電路一般由ROM實(shí)現(xiàn)；D/A轉(zhuǎn)換電路，將數(shù)字形式的幅度碼轉(zhuǎn)換成模擬信號(hào)。 現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)設(shè)計(jì)靈活、速度快，在數(shù)字專(zhuān)用集成電路的設(shè)計(jì)中得到了廣泛的應(yīng)用。本論文主要討論了如何利用FPGA來(lái)實(shí)現(xiàn)一個(gè)DDS系統(tǒng)，該DDS系統(tǒng)的硬件結(jié)構(gòu)是以FPGA為核心實(shí)現(xiàn)的，使用Altera公司的Cyclone系列FPGA。 文章首先介紹了頻率合成器的發(fā)展，闡述了基于FPGA實(shí)現(xiàn)DDS技術(shù)的意義；然后介紹了DDS的基本理論；接著介紹了FPGA的基礎(chǔ)知識(shí)如結(jié)構(gòu)特點(diǎn)、開(kāi)發(fā)流程、使用工具等；隨后介紹了利用FPGA實(shí)現(xiàn)直接數(shù)字頻率合成(DDS)的原理、電路結(jié)構(gòu)、優(yōu)化方法等。重點(diǎn)介紹DDS技術(shù)在FPGA中的實(shí)現(xiàn)方法，給出了部分VHDL源程序。采用該方法設(shè)計(jì)的DDS系統(tǒng)可以很容易地嵌入到其他系統(tǒng)中而不用外接專(zhuān)用DDS芯片，具有高性能、高性?xún)r(jià)比，電路結(jié)構(gòu)簡(jiǎn)單等特點(diǎn)；接著對(duì)輸出信號(hào)頻譜進(jìn)行了分析，特別是對(duì)信號(hào)的相位截?cái)嗾`差和幅度量化誤差進(jìn)行了詳細(xì)的討論，由此得出了改善系統(tǒng)性能的幾種方法；最后給出硬件實(shí)物照片和測(cè)試結(jié)果，并對(duì)此作了一定的分析。
上傳時(shí)間： 2013-07-05
上傳用戶(hù)：suxuan110425
隨著國(guó)民經(jīng)濟(jì)的發(fā)展和社會(huì)的進(jìn)步，人們?cè)絹?lái)越需要便捷的交通工具，從而促進(jìn)了汽車(chē)工業(yè)的發(fā)展，同時(shí)汽車(chē)發(fā)動(dòng)機(jī)檢測(cè)維修等相關(guān)行業(yè)也發(fā)展起來(lái)。在汽車(chē)發(fā)動(dòng)機(jī)檢測(cè)維修中，發(fā)動(dòng)機(jī)電腦(Electronic Control．Unit-ECU)檢測(cè)維修是其中最關(guān)鍵的部分。發(fā)動(dòng)機(jī)電腦根據(jù)發(fā)動(dòng)機(jī)的曲軸或凸輪軸傳感器信號(hào)控制發(fā)動(dòng)機(jī)的噴油、點(diǎn)火和排氣。所以，維修發(fā)動(dòng)機(jī)電腦時(shí)，必須對(duì)其施加正確的信號(hào)。目前，許多發(fā)動(dòng)機(jī)的曲軸和凸輪軸傳感器信號(hào)已不再是正弦波和方波等傳統(tǒng)信號(hào)，而是多種復(fù)雜波形信號(hào)。為了能夠提供這種信號(hào)，本文研究并設(shè)計(jì)了一種能夠產(chǎn)生復(fù)雜波形的低成本任意波形發(fā)生器(Arbitrary Waveform Generator-AWG)。 本文提出的任意波形發(fā)生器依據(jù)直接數(shù)字頻率合成(Direct Digial FrequencySynthesis-DDFS)原理，采用自行設(shè)計(jì)現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)的方案實(shí)現(xiàn)頻率合成，擴(kuò)展數(shù)據(jù)存儲(chǔ)器存儲(chǔ)波形的量化幅值(波形數(shù)據(jù))，在微控制單元(MCU)的控制與協(xié)調(diào)下輸出頻率和相位均可調(diào)的信號(hào)。 任意波形發(fā)生器主要由用戶(hù)控制界面、DDFS模塊、放大及濾波、微控制器系統(tǒng)和電源模塊五部分組成。在設(shè)計(jì)中采用FPGA芯片EPF10K10QC208-4實(shí)現(xiàn)DDFS的硬件算法。波形調(diào)整及濾波由兩級(jí)放大電路來(lái)完成：第一級(jí)對(duì)D/A輸出信號(hào)進(jìn)行調(diào)整；第二級(jí)完成信號(hào)濾波及信號(hào)幅值和偏移量的調(diào)節(jié)。電源模塊利用三端集成穩(wěn)壓器進(jìn)行電壓值變換，利用極性轉(zhuǎn)換芯片ICL7660實(shí)現(xiàn)正負(fù)極性轉(zhuǎn)換。 該任意波形發(fā)生器與通用模擬信號(hào)源相比具有：輸出頻率誤差小，分辨率高，可產(chǎn)生任意波形，成本低，體積小，使用方便，工作穩(wěn)定等優(yōu)點(diǎn)，十分適合汽車(chē)維修行業(yè)使用，具有較好的市場(chǎng)前景。
標(biāo)簽： FPGA 任意波形發(fā)生器
上傳時(shí)間： 2013-05-28
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