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服務(wù)器模塊

  • 源碼公開的MCS-51單片機(jī)宏匯編器

    周立功的一份文檔,介紹源碼公開的MCS-51單片機(jī)宏匯編器,本是一應(yīng)屆生的習(xí)作,是學(xué)習(xí)編譯原理和C程序設(shè)計(jì)的“靶子”,雖然該軟件未完全達(dá)到滿意效果,不過與Keil公司的A51配合起來使用還是不錯(cuò)的。

    標(biāo)簽: MCS 51 源碼 單片機(jī)

    上傳時(shí)間: 2013-05-19

    上傳用戶:axxsa

  • 基于FPGA技術(shù)的HDLC幀收發(fā)器

    基于FPGA技術(shù)的HDLC幀收發(fā)器的設(shè)計(jì)與實(shí)現(xiàn)

    標(biāo)簽: FPGA HDLC 收發(fā)器

    上傳時(shí)間: 2013-05-24

    上傳用戶:lindor

  • USBISP下載器驅(qū)動(dòng)

    USBISP下載器驅(qū)動(dòng)USBISP下載器驅(qū)動(dòng)及說明(USBISP配置用戶用)\RZ-USBISP使用說明

    標(biāo)簽: USBISP 下載器 驅(qū)動(dòng)

    上傳時(shí)間: 2013-07-03

    上傳用戶:coeus

  • 可重構(gòu)24bit音頻過采樣DAC的FPGA

    基于過采樣和∑-△噪聲整形技術(shù)的DAC能夠可靠地把數(shù)字信號(hào)轉(zhuǎn)換為高精度的模擬信號(hào)(大于等于16位)。采用這一架構(gòu)進(jìn)行數(shù)模轉(zhuǎn)換具有諸多優(yōu)點(diǎn),例如極低的失配噪聲和更高的可靠性,便于實(shí)現(xiàn)嵌入式集成等,最重要的是可以得到其他DAC結(jié)構(gòu)所無法達(dá)到的精度和動(dòng)態(tài)范圍。在高精度測(cè)量,音頻轉(zhuǎn)換,汽車電子等領(lǐng)域有著廣泛的應(yīng)用價(jià)值。 本文采用∑-△結(jié)構(gòu)以FPGA方式實(shí)現(xiàn)了一個(gè)具有高精度的數(shù)模轉(zhuǎn)換器,在24比特的輸入信號(hào)下,達(dá)到了約150dB的信噪比。作為一個(gè)靈活的音頻DAC實(shí)現(xiàn)方案。該DAC可以對(duì)CD/DVD/HDCD/SACD等多種制式下的音頻信號(hào)進(jìn)行處理,接受并轉(zhuǎn)換采樣率為32/44.1/48/88.2/96/192kHz,字長(zhǎng)為16/18/20/24比特的PCM數(shù)據(jù),具備良好的兼容性和通用性。 由于非線性和不穩(wěn)定性的存在,高階∑-△調(diào)制器的設(shè)計(jì)與實(shí)現(xiàn)存在較大的難度。本文綜合大量文獻(xiàn)中的經(jīng)驗(yàn)原則和方法,闡述了穩(wěn)定的高階高精度調(diào)制器的設(shè)計(jì)流程;并據(jù)此設(shè)計(jì)了達(dá)到24bit精度和滿量程輸入范圍的的5階128倍調(diào)制器。本文創(chuàng)新性地提出了∑-△調(diào)制器的一種高效率流水線實(shí)現(xiàn)結(jié)構(gòu)。分析表明,與其他常見的∑-△調(diào)制器實(shí)現(xiàn)結(jié)構(gòu)相比,本方案具有結(jié)構(gòu)簡(jiǎn)單、運(yùn)算單元少等優(yōu)點(diǎn);此外在同樣信號(hào)采樣率下,調(diào)制器所需的時(shí)鐘頻率大大降低。 文中的過采樣濾波模塊采用三級(jí)半帶濾波器和一個(gè)可變CIC濾波器級(jí)聯(lián)組成,可以達(dá)到最高128倍的過采樣比,同時(shí)具有良好的通帶和阻帶特性。在半帶濾波器的設(shè)計(jì)中采用了CSD編碼,使結(jié)構(gòu)得到了充分的簡(jiǎn)化。 本文提出的過采樣DAC方案具有可重配置結(jié)構(gòu),讓使用者能夠方便地控制過采樣比和調(diào)制器階數(shù)。通過積分梳狀濾波器的配置,能夠獲得32/64/128倍的不同過采樣比,從而實(shí)現(xiàn)對(duì)于32~192kHz多種采樣率輸入的處理。在不同輸入字長(zhǎng)情況下,通過調(diào)制器的重構(gòu),則可以將調(diào)制器由高精度的5階模式改變?yōu)楣母偷?階模式,滿足不同分辨率信號(hào)輸入時(shí)的不同精度要求。這是本文的另一創(chuàng)新之處。 目前,該過采樣DAC已經(jīng)在XilinxVirtexⅡ系列FPGA器件下得到硬件實(shí)現(xiàn)和驗(yàn)證。測(cè)試表明,對(duì)于從32kHz到192kHz的不同輸入信號(hào),該DAC模塊輸出1比特碼流的帶內(nèi)信噪比均能滿足24比特?cái)?shù)據(jù)轉(zhuǎn)換應(yīng)用的分辨率要求。

    標(biāo)簽: FPGA bit DAC 24

    上傳時(shí)間: 2013-07-08

    上傳用戶:從此走出陰霾

  • C8051編程器資料

    c8051編程器資料,u-ec2,u-ec5,u-pdc 資料

    標(biāo)簽: C8051 編程器

    上傳時(shí)間: 2013-05-31

    上傳用戶:1134473521

  • 卷積Turbo碼編譯碼器FPGA實(shí)現(xiàn)

    卷積Turbo碼因其優(yōu)異的糾錯(cuò)性能越來越受人門的關(guān)注,而編碼器和譯碼器是編碼理論實(shí)際應(yīng)用的重點(diǎn)和難點(diǎn)。論文根據(jù)IEEE802.16e標(biāo)準(zhǔn),以低時(shí)延、高吞吐量、支持高時(shí)鐘頻率、參數(shù)可配置為目標(biāo),對(duì)卷積Turbo碼編碼器和譯碼器的FPG...

    標(biāo)簽: Turbo FPGA 卷積 編譯碼器

    上傳時(shí)間: 2013-05-19

    上傳用戶:cuibaigao

  • 時(shí)分交替ADC系統(tǒng)數(shù)字校準(zhǔn)算法

    隨著現(xiàn)代通信與信號(hào)處理技術(shù)的不斷發(fā)展,對(duì)于高速高精度AD轉(zhuǎn)換器的需求越來越大。但是,隨著集成電路工藝中電路特征線寬的不斷減小,在傳統(tǒng)單通道ADC框架下同時(shí)實(shí)現(xiàn)高速、高精度的數(shù)模轉(zhuǎn)換愈加困難。此時(shí),時(shí)分交替ADC 作為...

    標(biāo)簽: ADC 時(shí)分 數(shù)字校準(zhǔn)

    上傳時(shí)間: 2013-07-08

    上傳用戶:mylinden

  • 555定時(shí)器電路設(shè)計(jì)軟件

    555定時(shí)器電路設(shè)計(jì)軟件,有很多555電路參數(shù)的計(jì)算

    標(biāo)簽: 555 定時(shí)器電路 設(shè)計(jì)軟件

    上傳時(shí)間: 2013-04-24

    上傳用戶:戀天使569

  • 基于vhdl的移位寄存器設(shè)計(jì)

    16位帶有并行預(yù)置功能的右移移位寄存器,CLK1是時(shí)鐘信號(hào), LOAD是并行數(shù)據(jù)使能信號(hào),QB是串行輸出端口

    標(biāo)簽: vhdl 移位寄存器

    上傳時(shí)間: 2013-04-24

    上傳用戶:diamondsGQ

  • 直流斬波器工作原理

    簡(jiǎn)介直流斬波器工作原理,有直流展播電路阿四分紅派個(gè) 一個(gè)一個(gè)

    標(biāo)簽: 直流 斬波器 工作原理

    上傳時(shí)間: 2013-06-12

    上傳用戶:guh000

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