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時間校準(zhǔn)

這是CRC字符串校驗的源碼

這是CRC字符串校驗的源碼，可對字符串校驗后輸出校驗碼

標(biāo)簽： CRC 字符串源碼

上傳時間： 2017-04-11

上傳用戶：zyt
-- 本模塊的功能是驗證實現(xiàn)和PC機進(jìn)行基本的串口通信的功能。需要在 --PC機上安裝一個串口調(diào)試工具來驗證程序的功能。 -- 程序?qū)崿F(xiàn)了一個收發(fā)一幀10個bit（即無奇偶校驗位）的串口控 --

-- 本模塊的功能是驗證實現(xiàn)和PC機進(jìn)行基本的串口通信的功能。需要在 --PC機上安裝一個串口調(diào)試工具來驗證程序的功能。 -- 程序?qū)崿F(xiàn)了一個收發(fā)一幀10個bit（即無奇偶校驗位）的串口控 --制器，10個bit是1位起始位，8個數(shù)據(jù)位，1個結(jié)束 --位。串口的波特律由程序中定義的div_par參數(shù)決定，更改該參數(shù)可以實 --現(xiàn)相應(yīng)的波特率。程序當(dāng)前設(shè)定的div_par 的值是0x104，對應(yīng)的波特率是 --9600。用一個8倍波特率的時鐘將發(fā)送或接受每一位bit的周期時間 --劃分為8個時隙以使通信同步. --程序的工作過程是：串口處于全雙工工作狀態(tài)，按動SW0，CPLD向PC發(fā)送“welcome" --字符串（串口調(diào)試工具設(shè)成按ASCII碼接受方式）；PC可隨時向CPLD發(fā)送0-F的十六進(jìn)制 --數(shù)據(jù)，CPLD接受后顯示在7段數(shù)碼管上。

標(biāo)簽： bit 程序 PC 模塊

上傳時間： 2017-04-12

上傳用戶：lgnf
觸摸屏校驗

觸摸屏校驗，很簡單的使用，直接生成pointercal文件

標(biāo)簽： 觸摸屏

上傳時間： 2017-04-18

上傳用戶：ikemada
頻率合成器加數(shù)字調(diào)制芯片ADF7012的應(yīng)用 CRC校驗C程序擴(kuò)展I/O口芯片HC595程序

頻率合成器加數(shù)字調(diào)制芯片ADF7012的應(yīng)用 CRC校驗C程序擴(kuò)展I/O口芯片HC595程序

標(biāo)簽： 7012 ADF 595 CRC

上傳時間： 2017-04-18

上傳用戶：refent
LDPC碼既低密度奇偶校驗碼（Low Density Parity Check Code

LDPC碼既低密度奇偶校驗碼（Low Density Parity Check Code，LDPC），它由Robert G.Gallager博士于1963年提出的一類具有稀疏校驗矩陣的線性分組碼，不僅有逼近Shannon限的良好性能，而且譯碼復(fù)雜度較低, 結(jié)構(gòu)靈活，是近年信道編碼領(lǐng)域的研究熱點，目前已廣泛應(yīng)用于深空通信、光纖通信、衛(wèi)星數(shù)字視頻和音頻廣播等領(lǐng)域。LDPC碼已成為第四代通信系統(tǒng)(4G)

標(biāo)簽： Density Parity Check LDPC

上傳時間： 2013-12-24

上傳用戶：lunshaomo
C51與PC機通迅程序。。之間需設(shè)置通迅協(xié)議然后還需奇偶校驗。。

C51與PC機通迅程序。。之間需設(shè)置通迅協(xié)議然后還需奇偶校驗。。

標(biāo)簽： C51 PC機程序協(xié)議

上傳時間： 2014-12-04

上傳用戶：ljt101007
以NRF905芯片為核心的PTR8000模塊的AVR驅(qū)動.驅(qū)動芯片為AVR mega16或者AVR mega32.內(nèi)部詳盡的操作流程和時序.包括CRC16校驗.主從機通訊.

以NRF905芯片為核心的PTR8000模塊的AVR驅(qū)動.驅(qū)動芯片為AVR mega16或者AVR mega32.內(nèi)部詳盡的操作流程和時序.包括CRC16校驗.主從機通訊.

標(biāo)簽： AVR mega 8000 16

上傳時間： 2014-01-16

上傳用戶：Andy123456
計時器模式1模擬秒變化 7段顥示器 8051程式

計時器模式1模擬秒變化 7段顥示器 8051程式

標(biāo)簽： 8051 模式模程式

上傳時間： 2017-04-20

上傳用戶：gundan
用VHDL實現(xiàn)3位二進(jìn)制信息碼的并行偶發(fā)生及校驗電路

用VHDL實現(xiàn)3位二進(jìn)制信息碼的并行偶發(fā)生及校驗電路

標(biāo)簽： VHDL 二進(jìn)制并行發(fā)生

上傳時間： 2013-12-24

上傳用戶：三人用菜
摘要:電壓監(jiān)測儀的校驗工作量大、效率和精度低

摘要:電壓監(jiān)測儀的校驗工作量大、效率和精度低，為保證電壓監(jiān)測儀性能指標(biāo)，研制了一種對單相電壓監(jiān)測統(tǒng)計儀進(jìn)行精度、靈敏度、諧波、時間試驗的校驗裝置。裝置以高速單片機為核心，利用豐富的P C機資源、融合F P G A 技術(shù)、點陣圖形液晶等技術(shù)，實現(xiàn)監(jiān)測儀誤差校驗過程的自動控制、微機數(shù)據(jù)管理、程控操作、故障保護(hù)。實驗結(jié)果表明裝置綜合誤差為0 . 1 級，輸出電壓失真度小于0 . 5 ，系統(tǒng)運行準(zhǔn)確、數(shù)據(jù)傳輸可靠、操作方便及功能完善。

標(biāo)簽： 電壓監(jiān)測儀效率精度

上傳時間： 2014-07-05

上傳用戶：stella2015

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