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  • win7_系統(tǒng)下_安裝Cadence后提示“丟失msvcr90.dll”錯誤

    win7_系統(tǒng)下_安裝Cadence后提示“丟失msvcr90.dll”錯誤

    標簽: Cadence msvcr win dll

    上傳時間: 2015-01-01

    上傳用戶:gaojiao1999

  • Protel99 window7系統(tǒng)下添加元件庫軟件

    大家都知道protel99在win7下,元件庫加不上去。而這個軟件正好能解決這個問題。我用了感覺不錯,特地分享給大家

    標簽: window7 Protel 99

    上傳時間: 2013-11-03

    上傳用戶:zhouli

  • win7下在Protel99se中添加PCB封裝庫的方法

    win7下如何添加PCB封裝庫

    標簽: Protel win7 PCB 99

    上傳時間: 2015-01-01

    上傳用戶:love1314

  • FPGA開發(fā)攻略下

    FPGA開發(fā)攻略下

    標簽: FPGA

    上傳時間: 2013-11-15

    上傳用戶:18602424091

  • WIN7操作系統(tǒng)下,protel99se添加元件庫的操作方法

    WIN7操作系統(tǒng)下,protel99se添加元件庫的操作方法

    標簽: protel WIN7 99 se

    上傳時間: 2013-10-12

    上傳用戶:s藍莓汁

  • Cadence完全學習手冊(下)

    這是蘭吉昌編寫的《Cadence完全自學手冊》的電子版,分上,中,下三冊,每冊17M左右,較大,資料相當全哦!

    標簽: Cadence 學習手冊

    上傳時間: 2013-10-25

    上傳用戶:小楓殘月

  • FPGA的HD-SDI下變換研究

    研究了一種采用FPGA將高清數(shù)字電視信號轉(zhuǎn)換為標清數(shù)字電視信號的方法,利用重采樣等技術降低了圖像中每行的有效像素和垂直行,完成了HD-SDI到SD-SDI的下變換。設計實現(xiàn)簡單,目前已運用于實際工程當中。

    標簽: HD-SDI FPGA 變換

    上傳時間: 2013-10-23

    上傳用戶:mikesering

  • LTE標準下Turbo碼編譯碼器的集成設計

    針對固定碼長Turbo碼適應性差的缺點,以LTE為應用背景,提出了一種幀長可配置的Turbo編譯碼器的FPGA實現(xiàn)方案。該設計可以依據(jù)具體的信道環(huán)境和速率要求調(diào)節(jié)信息幀長,平衡譯碼性能和系統(tǒng)時延。方案采用“自頂向下”的設計思想和“自底而上”的實現(xiàn)方法,對 Turbo編譯碼系統(tǒng)模塊化設計后優(yōu)化統(tǒng)一,經(jīng)時序仿真驗證后下載配置到Altera公司Stratix III系列的EP3SL150F1152C2N中。測試結(jié)果表明,系統(tǒng)運行穩(wěn)健可靠,并具有良好的移植性;集成化一體設計,為LTE標準下Turbo碼 ASIC的開發(fā)提供了參考。

    標簽: Turbo LTE 標準 編譯碼器

    上傳時間: 2013-10-08

    上傳用戶:回電話#

  • 基于FPGA的寬帶數(shù)字接收機變帶寬數(shù)字下變頻器設計

    基于FPGA芯片Stratix II EP2S60F672C4設計了一個適用于寬帶數(shù)字接收機的帶寬可變的數(shù)字下變頻器(VB-DDC)。該VB-DDC結(jié)合傳統(tǒng)數(shù)字下變頻結(jié)構與多相濾波結(jié)構的優(yōu)點,實現(xiàn)了對輸入中頻信號的高效高速處理,同時可以在較大范圍內(nèi)對信號處理帶寬靈活配置。硬件調(diào)試結(jié)果驗證了本設計的有效性。

    標簽: FPGA 寬帶數(shù)字 接收機 帶寬

    上傳時間: 2013-10-13

    上傳用戶:haiya2000

  • pcb layout design(臺灣硬件工程師15年經(jīng)驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或?qū)住?1. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-11-17

    上傳用戶:cjf0304

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