隨著信息技術(shù)的發(fā)展，數(shù)字信號(hào)的采集與處理在科學(xué)研究、工業(yè)生產(chǎn)、航空航天、醫(yī)療衛(wèi)生等部門得到越來越廣泛的應(yīng)用，這些應(yīng)用中對(duì)數(shù)字信號(hào)的傳輸速度提出了比較高的要求。傳統(tǒng)的基于ISA總線的信號(hào)傳輸效率低，嚴(yán)重制約著系統(tǒng)性能的提高。 PCI總線以其高性能、低成本、開放性、軟件兼容性等眾多優(yōu)點(diǎn)成為當(dāng)今最流行的計(jì)算機(jī)局部總線。但是，由于PCI總線硬件接口復(fù)雜、不易于接入、協(xié)議規(guī)范比較繁瑣等缺點(diǎn)，常常需要專用的接口芯片作為橋接，為了解決這一系列問題，本文提出了一種基于FPGA的PCI總線接口橋接邏輯的實(shí)現(xiàn)方案，支持PCI突發(fā)訪問方式，突發(fā)長(zhǎng)度為8至128個(gè)雙字長(zhǎng)度，核心FPGA芯片采用ALTERA公司的CYCLONE FPGA系列的EP1C6Q240C8，容量為6000個(gè)邏輯宏單元，速度為-8，編譯后系統(tǒng)速度可以達(dá)到80MHz，取得了良好的效果。 基于FPGA的PCI總線接口橋接邏輯的核心是PCI接口模塊。在硬件方面，特別討論了PCI接口模塊、地址轉(zhuǎn)換模塊、數(shù)據(jù)緩沖模塊、外部接口模塊和SRAM DMA控制模塊等五個(gè)功能模塊的設(shè)計(jì)方案和硬件電路實(shí)現(xiàn)方法，著重分析了PCI接口模塊的數(shù)據(jù)傳輸方式，采用模塊化的方法設(shè)計(jì)了內(nèi)部控制邏輯，并進(jìn)行了相關(guān)的時(shí)序仿真和邏輯驗(yàn)證，硬件需要軟件的配合才能實(shí)現(xiàn)其功能，因此設(shè)備驅(qū)動(dòng)程序的設(shè)計(jì)是一個(gè)重要部分，論文研究了Windows XP體系結(jié)構(gòu)下的WDM驅(qū)動(dòng)模式的組成、開發(fā)設(shè)備驅(qū)動(dòng)程序的工具以及開發(fā)系統(tǒng)實(shí)際硬件的設(shè)備驅(qū)動(dòng)程序時(shí)的一些關(guān)鍵技術(shù)。 本文最后利用基于FPGA的PCI總線接口橋接邏輯中的關(guān)鍵技術(shù)，對(duì)PCI數(shù)據(jù)采集卡進(jìn)行了整體方案的設(shè)計(jì)。該系統(tǒng)采用Altera公司的cyclone Ⅱ系列FPGA實(shí)現(xiàn)。
上傳時(shí)間： 2013-07-24
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隨著信息技術(shù)的發(fā)展，數(shù)字信號(hào)的采集與處理在科學(xué)研究、工業(yè)生產(chǎn)、航空航天、醫(yī)療衛(wèi)生等部門得到越來越廣泛的應(yīng)用，這些應(yīng)用中對(duì)數(shù)字信號(hào)的傳輸速度提出了比較高的要求。傳統(tǒng)的基于ISA總線的信號(hào)傳輸效率低，嚴(yán)重制約著系統(tǒng)性能的提高。 PCI總線以其高性能、低成本、開放性、軟件兼容性等眾多優(yōu)點(diǎn)成為當(dāng)今最流行的計(jì)算機(jī)局部總線。但是，由于PCI總線硬件接口復(fù)雜、不易于接入、協(xié)議規(guī)范比較繁瑣等缺點(diǎn)，常常需要專用的接口芯片作為橋接，為了解決這一系列問題，本文提出了一種基于FPGA的PCI總線接口橋接邏輯的實(shí)現(xiàn)方案，支持PCI突發(fā)訪問方式，突發(fā)長(zhǎng)度為8至128個(gè)雙字長(zhǎng)度，核心FPGA芯片采用ALTERA公司的CYCLONE FPGA系列的EP1C6Q240C8，容量為6000個(gè)邏輯宏單元，速度為-8，編譯后系統(tǒng)速度可以達(dá)到80MHz，取得了良好的效果。 基于FPGA的PCI總線接口橋接邏輯的核心是PCI接口模塊。在硬件方面，特別討論了PCI接口模塊、地址轉(zhuǎn)換模塊、數(shù)據(jù)緩沖模塊、外部接口模塊和SRAM DMA控制模塊等五個(gè)功能模塊的設(shè)計(jì)方案和硬件電路實(shí)現(xiàn)方法，著重分析了PCI接口模塊的數(shù)據(jù)傳輸方式，采用模塊化的方法設(shè)計(jì)了內(nèi)部控制邏輯，并進(jìn)行了相關(guān)的時(shí)序仿真和邏輯驗(yàn)證，硬件需要軟件的配合才能實(shí)現(xiàn)其功能，因此設(shè)備驅(qū)動(dòng)程序的設(shè)計(jì)是一個(gè)重要部分，論文研究了Windows XP體系結(jié)構(gòu)下的WDM驅(qū)動(dòng)模式的組成、開發(fā)設(shè)備驅(qū)動(dòng)程序的工具以及開發(fā)系統(tǒng)實(shí)際硬件的設(shè)備驅(qū)動(dòng)程序時(shí)的一些關(guān)鍵技術(shù)。 本文最后利用基于FPGA的PCI總線接口橋接邏輯中的關(guān)鍵技術(shù)，對(duì)PCI數(shù)據(jù)采集卡進(jìn)行了整體方案的設(shè)計(jì)。該系統(tǒng)采用Altera公司的cyclone Ⅱ系列FPGA實(shí)現(xiàn)。
上傳時(shí)間： 2013-05-22
上傳用戶：彭玖華
諸如電信設(shè)備、存儲(chǔ)模塊、光學(xué)繫統(tǒng)、網(wǎng)絡(luò)設(shè)備、服務(wù)器和基站等許多復(fù)雜繫統(tǒng)都采用了 FPGA 和其他需要多個(gè)電壓軌的數(shù)字 IC，這些電壓軌必須以一個(gè)特定的順序進(jìn)行啟動(dòng)和停機(jī)操作，否則 IC 就會(huì)遭到損壞。
上傳時(shí)間： 2014-12-24
上傳用戶：packlj
cypress的usb接ata源代碼，絕對(duì)經(jīng)典，可以接scsi硬盤哦，支持DMA方式，就一個(gè)字，強(qiáng)。
上傳時(shí)間： 2013-12-02
上傳用戶：奇奇奔奔
模塊使用外部濾波器回路來抑制信號(hào)抖動(dòng)和電磁干擾。濾波器回路由PLL接在濾波器輸入引腳PLLF和PLLF2之間的電阻Rl和電容Cl、C2組成。電容 Cl、C2必須為無極性電容。在不同的振蕩器頻率下，R1、Cl、C2的取值不同，常用的參數(shù)組合如表l所列。PLL模塊的電源引腳PLLVCCA分別通過磁珠和0.1μF的電容與數(shù)字電源引腳VDD和數(shù)字地引腳VSS連接，構(gòu)成低通濾波電路，保證時(shí)鐘模塊的可靠供電。模塊使用外部濾波器回路來抑制信號(hào)抖動(dòng)和電磁干擾。濾波器回路由PLL接在濾波器輸入引腳PLLF和PLLF2之間的電阻Rl和電容Cl、C2組成。電容 Cl、C2必須為無極性電容。在不同的振蕩器頻率下，R1、Cl、C2的取值不同，常用的參數(shù)組合如表l所列。PLL模塊的電源引腳PLLVCCA分別通過磁珠和0.1μF的電容與數(shù)字電源引腳VDD和數(shù)字地引腳VSS連接，構(gòu)成低通濾波電路，保證時(shí)鐘模塊的可靠供電。
上傳時(shí)間： 2014-01-07
上傳用戶：ikemada
摘 要： 本文件是C8051單片機(jī)字庫（GB2312）測(cè)試實(shí)驗(yàn)程序；使用外部22.1184MHz晶振. 功能：定義 0 ~ 3 、 A 、 F 為功能鍵。按"A" 鍵顯示輸入位碼界面，按 0 鍵頁位置加1，按 1 鍵字位置加1， 按 2 鍵頁位置減1，按 3 鍵字位置減1，并在LCD上顯示該漢字。按"F"返回顯示待機(jī)界面。
標(biāo)簽： 22.1184 C8051 2312 MHz
上傳時(shí)間： 2015-09-02
上傳用戶：rocketrevenge
摘 要： 本文件是C8051單片機(jī)I2C總線讀寫測(cè)試程序；將跳線器JP6短接，使用外部22.1184MHz晶振. 功能：定義 0 ~ 9 鍵為數(shù)字鍵， A ~ F 為功能鍵。按 A 鍵后，可按0 ~ 9 數(shù)字鍵， 從零地址開始存儲(chǔ)該鍵值，并送LED數(shù)碼管上顯示該鍵值。按 C 鍵停止后，按 B 鍵， 從零地址開始讀取數(shù)據(jù)值，并送LED數(shù)碼管上顯示。讀取速度每秒一次。在按 C 鍵停止后，可按 A 鍵重新輸入。
標(biāo)簽： C8051 I2C JP6 單片機(jī)
上傳時(shí)間： 2015-09-02
上傳用戶：sevenbestfei
一個(gè)成語接龍的PERL程序，由電腦自動(dòng)出成語，然后用戶根據(jù)成語的最后一個(gè)字進(jìn)行接龍，如接不上，可選擇由電腦給出
上傳時(shí)間： 2013-12-20
上傳用戶：VRMMO
本文件是I2C總線讀寫測(cè)試程序；將跳線器JP6短接，使用外部22.1184MHz晶振. 功能：定義 0 ~ 9 鍵為數(shù)字鍵， A ~ F 為功能鍵。按 A 鍵后，可按0 ~ 9 數(shù)字鍵， 從零地址開始存儲(chǔ)該鍵值，并送LED數(shù)碼管上顯示該鍵值。按 B 鍵后，從零地 址開始讀取數(shù)據(jù)值，并送LED數(shù)碼管上顯示。讀取速度每秒一次。按 C 鍵后， 停止任何操作。
上傳時(shí)間： 2013-12-21
上傳用戶：guanliya
對(duì) PCI 9052 橋接芯片實(shí)現(xiàn) PCI 接口， WDM 驅(qū)動(dòng)程序構(gòu)造方法，驅(qū)動(dòng)程序 I/O傳輸操作，驅(qū)動(dòng)程序各例程的主要代碼實(shí)現(xiàn)，多線程完成多模塊并行操作，LabWindows / CVI 實(shí)現(xiàn)虛擬儀器設(shè)計(jì)，套接字Socket 實(shí)現(xiàn)網(wǎng)絡(luò)傳輸?shù)汝P(guān)鍵技術(shù)進(jìn)行詳細(xì)闡述。
上傳時(shí)間： 2014-01-22
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