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帶隙基準(zhǔn)源

  • * 本算法用最小二乘法依據指定的M個基函數及N個已知數據進行曲線擬和 * 輸入: m--已知數據點的個數M * f--M維基函數向量 * n--已知數據點的個數N-1 * x--已知數

    * 本算法用最小二乘法依據指定的M個基函數及N個已知數據進行曲線擬和 * 輸入: m--已知數據點的個數M * f--M維基函數向量 * n--已知數據點的個數N-1 * x--已知數據點第一坐標的N維列向量 * y--已知數據點第二坐標的N維列向量 * a--無用 * 輸出: 函數返回值為曲線擬和的均方誤差 * a為用基函數進行曲線擬和的系數, * 即a[0]f[0]+a[1]f[1]+...+a[M]f[M].

    標簽: 數據 函數 算法 最小二乘法

    上傳時間: 2015-07-26

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  • 本算法用最小二乘法依據指定的M個基函數及N個已知數據進行曲線擬和 。 本算法用指數平滑法預測數據

    本算法用最小二乘法依據指定的M個基函數及N個已知數據進行曲線擬和 。 本算法用指數平滑法預測數據

    標簽: 算法 數據 最小二乘法 函數

    上傳時間: 2013-12-27

    上傳用戶:lijinchuan

  • matlab格式源代碼。功能:徑向基神經網絡算法源碼和應用于時間序列模型建立和預測問題。

    matlab格式源代碼。功能:徑向基神經網絡算法源碼和應用于時間序列模型建立和預測問題。

    標簽: matlab 源代碼 徑向 應用于

    上傳時間: 2014-01-01

    上傳用戶:541657925

  • pcb layout規則

    LAYOUT REPORT .............. 1   目錄.................. 1     1. PCB LAYOUT 術語解釋(TERMS)......... 2     2. Test Point : ATE 測試點供工廠ICT 測試治具使用............ 2     3. 基準點 (光學點) -for SMD:........... 4     4. 標記 (LABEL ING)......... 5     5. VIA HOLE PAD................. 5     6. PCB Layer 排列方式...... 5     7.零件佈置注意事項 (PLACEMENT NOTES)............... 5     8. PCB LAYOUT 設計............ 6     9. Transmission Line ( 傳輸線 )..... 8     10.General Guidelines – 跨Plane.. 8     11. General Guidelines – 繞線....... 9     12. General Guidelines – Damping Resistor. 10     13. General Guidelines - RJ45 to Transformer................. 10     14. Clock Routing Guideline........... 12     15. OSC & CRYSTAL Guideline........... 12     16. CPU

    標簽: layout pcb

    上傳時間: 2013-12-20

    上傳用戶:康郎

  • pcb layout規則

    LAYOUT REPORT .............. 1   目錄.................. 1     1. PCB LAYOUT 術語解釋(TERMS)......... 2     2. Test Point : ATE 測試點供工廠ICT 測試治具使用............ 2     3. 基準點 (光學點) -for SMD:........... 4     4. 標記 (LABEL ING)......... 5     5. VIA HOLE PAD................. 5     6. PCB Layer 排列方式...... 5     7.零件佈置注意事項 (PLACEMENT NOTES)............... 5     8. PCB LAYOUT 設計............ 6     9. Transmission Line ( 傳輸線 )..... 8     10.General Guidelines – 跨Plane.. 8     11. General Guidelines – 繞線....... 9     12. General Guidelines – Damping Resistor. 10     13. General Guidelines - RJ45 to Transformer................. 10     14. Clock Routing Guideline........... 12     15. OSC & CRYSTAL Guideline........... 12     16. CPU

    標簽: layout pcb

    上傳時間: 2013-10-29

    上傳用戶:1234xhb

  • 惡魔城-曉月圓舞曲 JAVA手機遊戲

    惡魔城-曉月圓舞曲 JAVA手機遊戲,帶源程序與圖片資源

    標簽: JAVA

    上傳時間: 2013-12-20

    上傳用戶:tianyi223

  • 這個是去年寫的東東。 以前公司一直使用易飛ERP

    這個是去年寫的東東。 以前公司一直使用易飛ERP,也因此自學了Delphi(本人以前一直使用VFP), 這是第一個模擬易飛界面的東東。 以前有進過易飛俱樂部論壇(http://www.dcmsclub.com)的朋友可能有下載過。 裏面使用到的都是D7裏自帶的標準組件. 認識一些共同研究易飛及Delphi編程方面的朋友. 由于本人也在處于入門階段,非常感謝盒子及各位朋友的幫助。3Q! 先把MainMenu.exe文件改名下(可不要覆蓋掉原來易飛的文件啊), 解壓復制到易飛安裝目錄下的c_dsbin文件夾裏 如 易飛安裝在D盤的Conductor 文件夾,則解壓至D:\Conductor\c_dsbin 注:本源碼只供新手參考,有錯的請指出。

    標簽: ERP

    上傳時間: 2016-11-07

    上傳用戶:lanhuaying

  • 一種高電源抑制比的CMOS帶隙基準電壓源設計

    介紹一種基于CSMC0.5 μm工藝的低溫漂高電源抑制比帶隙基準電路。本文在原有Banba帶隙基準電路的基礎上,通過采用共源共柵電流鏡結構和引入負反饋環路的方法,大大提高了整體電路的電源抑制比。 Spectre仿真分析結果表明:在-40~100 ℃的溫度范圍內,輸出電壓擺動僅為1.7 mV,在低頻時達到100 dB以上的電源抑制比(PSRR),整個電路功耗僅僅只有30 μA。可以很好地應用在低功耗高電源抑制比的LDO芯片設計中。

    標簽: CMOS 高電源抑制 帶隙基準 電壓源

    上傳時間: 2013-10-27

    上傳用戶:thesk123

  • 一種高精度帶隙基準源

    在傳統正溫度系數電流基礎上,增加兩種不同材料的電阻以實現帶隙基準的二階溫度補償,采用具有反饋偏置的折疊共源共柵運算放大器,使得所設計的帶隙基準電路,具有較高的精度和溫度穩定性。

    標簽: 高精度 帶隙基準源

    上傳時間: 2013-10-18

    上傳用戶:604759954

  • 一種高電源抑制比帶隙基準電壓源的設計

    摘要:采用共源共柵運算放大器作為驅動,設計了一種高電源抑制比和低溫度系數的帶隙基準電壓源電路,并在TSMC0.18Um CMOS工藝下,采用HSPICE進行了仿真.仿真結果表明:在-25耀115益溫度范圍內電路的溫漂系數為9.69伊10-6/益,電源抑制比達到-100dB,電源電壓在2.5耀4.5V之間時輸出電壓Vref的擺動為0.2mV,是一種有效的基準電壓實現方法.關鍵詞:帶隙基準電壓源;電源抑制比;溫度系數

    標簽: 高電源抑制 帶隙基準 電壓源

    上傳時間: 2013-11-19

    上傳用戶:王成林。

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