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基于FPGA的超聲波避障系統設計

  • FPGA的51內核（全）

    基于FPGA的51內核設計，全面適合大學生畢業設計的內核

    標簽： FPGA 51內核

    上傳時間： 2013-05-24

    上傳用戶：www123lll

  • 基于MPC92433的高頻時鐘電路的設計

    提出一種高頻時鐘電路的設計方案。利用一款先進的可編程時鐘合成器MPC92433，基于FPGA的控制，實現4對LVDS信號輸出。系統經過測試，輸出時鐘信號頻率達到1 GHz，可以廣泛應用到各種數字電路設計中。

    標簽： 92433 MPC 高頻時鐘 電路

    上傳時間： 2013-10-18

    上傳用戶：123456wh

  • 基于FPGA的交通路口車流量檢測方法研究

    為了使車流在交通路口順暢通過，通常需要統計一個交通信號燈周期內的車流量，以實現交通信號燈的自動配時。文中提出了一種交通路口的車流量檢測算法。通過在道路前方設置檢測線，進而統計檢測線灰度變化的情況，即可統計出通過的車流量。并對其進行FPGA的硬件仿真。實驗結果表明，此方法實現簡單，運算處理速度快，能夠得到較滿意的結果。

    標簽： FPGA 交通路口 車流量檢測 方法研究

    上傳時間： 2014-01-17

    上傳用戶：simonpeng

  • 基于FPGA的CPU設計

    FPGA的CPU設計

    標簽： FPGA CPU

    上傳時間： 2015-01-01

    上傳用戶：lansedeyuntkn

  • 多級小波逆變換實時系統方案

    提出了一種基于FPGA的多級小波逆變換的高速、實時的硬件解決方案。仿真驗證表明本方案能夠滿足連續輸入的數據進行實時處理的要求,并且所設計的系統具有功耗低、成本低等優點。

    標簽： 多級 小波逆變換 實時系統 方案

    上傳時間： 2013-12-20

    上傳用戶：JasonC

  • 基于FPGA的K9F4G08Flash控制器設計

    設計了一種能使FPGA的主狀態機直接管理Flash的控制器，該控制器具有自己的指令集和中斷管理方式。用戶可以根據FPGA的系統時鐘對控制器進行操作，無需關心Flash對指令和數據的時序要求。控制器建立了自己的壞塊管理機制，合并了一些Flash的常用關聯指令，方便了用戶對FPGA主狀態機的設計。

    標簽： Flash FPGA G08 9F

    上傳時間： 2013-10-28

    上傳用戶：wangzhen1990

  • 基于FPGA的數字三相鎖相環的優化設計

    數字三相鎖相環中含有大量乘法運算和三角函數運算，占用大量的硬件邏輯資源。為此，提出一種數字三相鎖相環的優化實現方案，利用乘法模塊復用和CORDIC算法實現三角函數運算，并用Verilog HDL硬件描述語言對優化前后的算法進行了編碼實現。仿真和實驗結果表明，優化后的數字三相鎖相環大大節省了FPGA的資源，并能快速、準確地鎖定相位，具有良好的性能。

    標簽： FPGA 數字 三相 優化設計

    上傳時間： 2013-10-22

    上傳用戶：emhx1990

  • 基于FPGA的多路高速串并轉換器設計

    高速串并轉換器的設計是FPGA 設計的一個重要方面,傳統設計方法由于采用FPGA 的內部邏輯資源來實現,從而限制了串并轉換的速度。該研究以網絡交換調度系統的FGPA 驗證平臺中多路高速串并轉換器的設計為例,詳細闡述了1 :8DDR 模式下高速串并轉換器的設計方法和16 路1 :8 串并轉換器的實現。結果表明,采用Xilinx Virtex24 的ISERDES 設計的多路串并轉換器可以實現800 Mbit/ s 輸入信號的串并轉換,并且減少了設計復雜度,縮短了開發周期,能滿足設計要求。關鍵詞:串并轉換;現場可編程邏輯陣列;Xilinx ; ISERDES

    標簽： FPGA 多路 串并轉換

    上傳時間： 2013-11-17

    上傳用戶：hxy200501

  • 本代碼介紹了使用VHDL開發FPGA的一般流程

    本代碼介紹了使用VHDL開發FPGA的一般流程，最終采用了一種基于FPGA的數字頻率的實現方法。該設計采用硬件描述語言VHDL，在軟件開發平臺ISE上完成，可以在較高速時鐘頻率（100MHz）下正常工作。該設計的頻率計能準確的測量頻率在1Hz到100MHz之間的信號。使用ModelSim仿真軟件對VHDL程序做了仿真，并完成了綜合布局布線，最終下載到芯片Spartan-II上取得良好測試效果。

    標簽： VHDL FPGA 代碼 流程

    上傳時間： 2014-01-12

    上傳用戶：hj_18

  • 這是一個基于NIOSII的俄羅斯方塊游戲設計

    這是一個基于NIOSII的俄羅斯方塊游戲設計，是基于FPGA的，利用流模式DMA傳輸實現游戲。

    標簽： NIOSII 俄羅斯方塊

    上傳時間： 2013-12-08

    上傳用戶：franktu

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