PLL是數(shù)字鎖相環(huán)設計源程序, 其中, Fi是輸入頻率(接收數(shù)據(jù)), 數(shù)字鎖相技術在通信領域應用非常廣泛，本例用VHDL描述了一個鎖相環(huán)作為參考，源碼已經(jīng)調試過。編譯器synplicty.Fo(Q5)是本地輸出頻率. 目的是從輸入數(shù)據(jù)中提取時鐘信號(Q5), 其頻率與數(shù)據(jù)速率一致, 時鐘上升沿鎖定在數(shù)據(jù)的上升和下降沿上；頂層文件是PLL.GDF
標簽：
PLL
數(shù)字鎖相環(huán)
接收
數(shù)字
上傳時間：
2013-12-31
上傳用戶：hphh
