cordic verilog 程序及仿真結(jié)果 8級(jí)流水線
資源簡介:cordic verilog 程序及仿真結(jié)果 8級(jí)流水線
上傳時(shí)間: 2014-01-17
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資源簡介:線性調(diào)頻脈沖壓縮(用于雷達(dá)方面)原理的簡單介紹和matlab仿真程序及仿真結(jié)果圖
上傳時(shí)間: 2013-11-26
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資源簡介:8.9 PSK調(diào)制與解調(diào)VHDL程序及仿真
上傳時(shí)間: 2013-12-26
上傳用戶:huangld
資源簡介:8.12 MASK調(diào)制VHDL程序及仿真,完增的、、用hdl完成了mask的編譯和仿真
上傳時(shí)間: 2013-12-23
上傳用戶:liglechongchong
資源簡介:FPGA很有價(jià)值的27實(shí)例.rar 包括 LED控制VHDL程序與仿真 2004.8修改.doc; LED控制VHDL程序與仿真; LCD控制VHDL程序與仿真 2004.8修改; LCD控制VHDL程序與仿真; ADC0809 VHDL控制程序; TLC5510 VHDL控制程序; DAC0832 接口電路程序; TLC7524接口...
上傳時(shí)間: 2013-12-22
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資源簡介:ASK調(diào)制與解調(diào)VHDL程序及仿真 \r\nFSK調(diào)制與解調(diào)VHDL程序及仿真\r\nPSK調(diào)制與解調(diào)VHDL程序及仿真\r\n基帶碼發(fā)生器程序設(shè)計(jì)與仿真\r\n頻率計(jì)程序設(shè)計(jì)與仿真
上傳時(shí)間: 2013-09-05
上傳用戶:edward_0608
資源簡介:ASK調(diào)制與解調(diào)VHDL程序及仿真 FSK調(diào)制與解調(diào)VHDL程序及仿真 PSK調(diào)制與解調(diào)VHDL程序及仿真 基帶碼發(fā)生器程序設(shè)計(jì)與仿真 頻率計(jì)程序設(shè)計(jì)與仿真
上傳時(shí)間: 2014-01-23
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資源簡介:ASK調(diào)制VHDL程序及仿真 基于VHDL硬件描述語言,對(duì)基帶信號(hào)進(jìn)行ASK振幅調(diào)制
上傳時(shí)間: 2013-12-27
上傳用戶:362279997
資源簡介:CPSK調(diào)制VHDL程序及仿真 基于VHDL硬件描述語言,對(duì)基帶信號(hào)進(jìn)行調(diào)制
上傳時(shí)間: 2013-12-17
上傳用戶:zycidjl
資源簡介:采用 DVB反向鏈路(DVB-RCS)標(biāo)準(zhǔn)中的雙二元Turbo碼matlab仿真程序和仿真結(jié)果。支持1/2和1/3碼率。支持MAP,LOG-MAP解碼算法。
上傳時(shí)間: 2015-11-19
上傳用戶:xhz1993
資源簡介:CRC-16的編解碼程序和仿真結(jié)果。統(tǒng)計(jì)了漏檢概率隨錯(cuò)誤比特?cái)?shù)目的曲線。
上傳時(shí)間: 2015-11-19
上傳用戶:lepoke
資源簡介:可以在PROTEUS下仿真的LPC2124向LCD輸出時(shí)鐘計(jì)數(shù)器值的程序及仿真電路。
上傳時(shí)間: 2016-03-02
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資源簡介:MFSK調(diào)制VHDL程序及仿真文件名:PL_MFSK --功能:基于VHDL硬件描述語言,完成對(duì)基帶信號(hào)的MFSK調(diào)制 --說明:這里MFSK的M為4
上傳時(shí)間: 2013-12-24
上傳用戶:aa17807091
資源簡介:這里面描述了很多關(guān)于LABVIEW的一些高級(jí)程序及仿真·
上傳時(shí)間: 2016-03-26
上傳用戶:nanfeicui
資源簡介:ASK調(diào)制與解調(diào)VHDL程序及仿真 FSK調(diào)制與解調(diào)VHDL程序及仿真 PSK調(diào)制與解調(diào)VHDL程序及仿真 MASK調(diào)制VHDL程序及仿真已經(jīng)調(diào)試好的程序
上傳時(shí)間: 2016-05-29
上傳用戶:fandeshun
資源簡介:液晶顯示C語言程序及仿真
上傳時(shí)間: 2014-01-10
上傳用戶:ayfeixiao
資源簡介:簡易頻率計(jì) 里面包含有程序及仿真 還有電路原理圖
上傳時(shí)間: 2014-01-26
上傳用戶:ruan2570406
資源簡介:本文是關(guān)于用RLS算法自適應(yīng)去噪的 包括原理 源程序 及仿真結(jié)果
上傳時(shí)間: 2013-11-27
上傳用戶:litianchu
資源簡介:基于keilc和proteus仿真實(shí)現(xiàn)的16*16點(diǎn)陣顯示程序以及仿真結(jié)果
上傳時(shí)間: 2016-12-28
上傳用戶:tyler
資源簡介:橢圓帶通IIR數(shù)字濾波器的MATLAB程序及仿真圖
上傳時(shí)間: 2013-12-02
上傳用戶:270189020
資源簡介:基于參數(shù)和非參數(shù)的多種頻譜檢測算法研究及仿真結(jié)果分析。
上傳時(shí)間: 2017-02-10
上傳用戶:agent
資源簡介:多功能波形發(fā)生器VHDL程序與仿真 URAT VHDL程序與仿真 ASK調(diào)制與解調(diào)VHDL程序及仿真 LCD控制VHDL程序與仿真
上傳時(shí)間: 2017-06-02
上傳用戶:onewq
資源簡介:關(guān)于PSK調(diào)制與解調(diào)的VHDL程序及仿真
上傳時(shí)間: 2017-07-07
上傳用戶:邶刖
資源簡介:程序及仿真工程文件程序及仿真工程文件程序及仿真工程文件
上傳時(shí)間: 2017-07-16
上傳用戶:2404
資源簡介:一款基于單片機(jī)開發(fā)的 的 推箱子經(jīng)典游戲的程序及仿真,電路圖
上傳時(shí)間: 2017-08-11
上傳用戶:zhanditian
資源簡介:2發(fā)射天線n接收天線MPSK調(diào)制下的AlamoutiMATLAB編碼及仿真結(jié)果
上傳時(shí)間: 2014-12-04
上傳用戶:yuzsu
資源簡介:一個(gè)32位微處理器的verilog實(shí)現(xiàn)源代脈,采用5級(jí)流水線和cache技術(shù).
上傳時(shí)間: 2014-12-21
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資源簡介:多功能波形發(fā)生器VHDL程序與仿真\r\nURAT VHDL程序與仿真\r\nASK調(diào)制與解調(diào)VHDL程序及仿真\r\n LCD控制VHDL程序與仿真
上傳時(shí)間: 2013-08-09
上傳用戶:pkkkkp
資源簡介:介紹verilog HDL, 內(nèi)容包括: – verilog應(yīng)用 – verilog語言的構(gòu)成元素 – 結(jié)構(gòu)級(jí)描述及仿真 – 行為級(jí)描述及仿真 – 延時(shí)的特點(diǎn)及說明 – 介紹verilog testbench • 激勵(lì)和控制和描述 • 結(jié)果的產(chǎn)生及驗(yàn)證 – 任務(wù)task及函數(shù)function ...
上傳時(shí)間: 2013-12-19
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資源簡介:這是PCM電話傳輸系統(tǒng)模型的verilog程序,是一個(gè)modlesim開發(fā)環(huán)境下的工程文件,并有波形仿真結(jié)果.
上傳時(shí)間: 2014-07-07
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