相 關(guān) 資 源

• 使用VHDL硬件描述語(yǔ)言實(shí)現(xiàn)了直接頻率合成器的制作免費(fèi)下載

  資源簡(jiǎn)介：使用VHDL硬件描述語(yǔ)言實(shí)現(xiàn)了直接頻率合成器的制作，并在Altera公司的CycloneII上得到實(shí)現(xiàn)，驗(yàn)證了代碼的正確性。用戶操作可以參照程序中的說(shuō)明，請(qǐng)使用QuartusII6.0以上版本打開(kāi)，低版本打開(kāi)時(shí)會(huì)有錯(cuò)誤提示

  標(biāo)簽： VHDL 硬件描述語(yǔ)言 頻率合成器

  上傳時(shí)間： 2017-01-10

  上傳用戶：清風(fēng)冷雨

• 硬件描述語(yǔ)言實(shí)現(xiàn)的dds和dds的測(cè)試程序免費(fèi)下載

  資源簡(jiǎn)介：硬件描述語(yǔ)言實(shí)現(xiàn)的dds和dds的測(cè)試程序，免費(fèi)下載

  標(biāo)簽： dds dds 硬件描述語(yǔ)言 測(cè)試程序

  上傳時(shí)間： 2014-11-26

  上傳用戶：yyq123456789

• 用VHDL硬件描述語(yǔ)言實(shí)現(xiàn)的對(duì)FPGA（Cyclone II）的配置的VHDL源代碼。免費(fèi)下載

  資源簡(jiǎn)介：用VHDL硬件描述語(yǔ)言實(shí)現(xiàn)的對(duì)FPGA（Cyclone II）的配置的VHDL源代碼。

  標(biāo)簽： VHDL Cyclone FPGA 硬件描述語(yǔ)言

  上傳時(shí)間： 2015-04-02

  上傳用戶：nanxia

• 這是一個(gè)I2C串行數(shù)據(jù)通信協(xié)議以VHDL硬件描述語(yǔ)言實(shí)現(xiàn)的IP核免費(fèi)下載

  資源簡(jiǎn)介：這是一個(gè)I2C串行數(shù)據(jù)通信協(xié)議以VHDL硬件描述語(yǔ)言實(shí)現(xiàn)的IP核，可直接編譯運(yùn)行

  標(biāo)簽： VHDL I2C 串行數(shù)據(jù) IP核

  上傳時(shí)間： 2015-04-27

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• fir ISP design fir VHDL VHDL編程濾波的硬件描述語(yǔ)言實(shí)現(xiàn)免費(fèi)下載

  資源簡(jiǎn)介：fir ISP design fir VHDL VHDL編程濾波的硬件描述語(yǔ)言實(shí)現(xiàn)，包括VHDL語(yǔ)言和verilog語(yǔ)言

  標(biāo)簽： VHDL fir design ISP

  上傳時(shí)間： 2014-06-20

  上傳用戶：xfbs821

• 用硬件描述語(yǔ)言實(shí)現(xiàn)的燈控IP核免費(fèi)下載

  資源簡(jiǎn)介：用硬件描述語(yǔ)言實(shí)現(xiàn)的燈控IP核，可實(shí)現(xiàn)至少256種顏色的真彩變換。

  標(biāo)簽： 硬件描述語(yǔ)言 燈控 IP核

  上傳時(shí)間： 2013-12-24

  上傳用戶：saharawalker

• 用VHDL硬件描述語(yǔ)言實(shí)現(xiàn)的良好運(yùn)行的三分頻電路免費(fèi)下載

  資源簡(jiǎn)介：用VHDL硬件描述語(yǔ)言實(shí)現(xiàn)的良好運(yùn)行的三分頻電路

  標(biāo)簽： VHDL 硬件描述語(yǔ)言 三分頻電路 運(yùn)行

  上傳時(shí)間： 2014-06-29

  上傳用戶：龍飛艇

• 使用verilog和VHDL兩種硬件描述語(yǔ)言實(shí)現(xiàn)了一個(gè)ATA硬盤控制器免費(fèi)下載

  資源簡(jiǎn)介：使用verilog和VHDL兩種硬件描述語(yǔ)言實(shí)現(xiàn)了一個(gè)ATA硬盤控制器，包括源代碼、測(cè)試仿真文件和說(shuō)明文檔

  標(biāo)簽： verilog VHDL ATA 硬件描述語(yǔ)言

  上傳時(shí)間： 2016-04-27

  上傳用戶：731140412

• 簡(jiǎn)述了V HDL 語(yǔ)言的功能及其特點(diǎn),并以 8 位串行數(shù)字鎖設(shè)計(jì)為例,介紹了在Max + plus Ⅱ10. 2 開(kāi)發(fā)軟件下,利用V HDL 硬件描述語(yǔ)言設(shè) 計(jì)數(shù)字邏輯電路的過(guò)程和方法。并設(shè)計(jì)了密免費(fèi)下載

  資源簡(jiǎn)介：簡(jiǎn)述了V HDL 語(yǔ)言的功能及其特點(diǎn),并以 8 位串行數(shù)字鎖設(shè)計(jì)為例,介紹了在Max + plus Ⅱ10. 2 開(kāi)發(fā)軟件下,利用V HDL 硬件描述語(yǔ)言設(shè) 計(jì)數(shù)字邏輯電路的過(guò)程和方法。并設(shè)計(jì)了密碼鎖

  標(biāo)簽： HDL plus Max 10

  上傳時(shí)間： 2013-12-23

  上傳用戶：yimoney

• 正交頻分復(fù)用的硬件描述語(yǔ)言實(shí)現(xiàn)免費(fèi)下載

  資源簡(jiǎn)介：正交頻分復(fù)用的硬件描述語(yǔ)言實(shí)現(xiàn)，atera環(huán)境

  標(biāo)簽： 正交頻分復(fù)用 硬件描述語(yǔ)言

  上傳時(shí)間： 2016-08-16

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• 一個(gè)用vhdl硬件描述語(yǔ)言實(shí)現(xiàn)的一個(gè)比較簡(jiǎn)單的除法器免費(fèi)下載

  資源簡(jiǎn)介：一個(gè)用vhdl硬件描述語(yǔ)言實(shí)現(xiàn)的一個(gè)比較簡(jiǎn)單的除法器

  標(biāo)簽： vhdl 硬件描述語(yǔ)言 比較 除法器

  上傳時(shí)間： 2017-06-12

  上傳用戶：waitingfy

• 這是一個(gè)用vhdl硬件描述語(yǔ)言實(shí)現(xiàn)的乘法器而不是多路選擇器免費(fèi)下載

  資源簡(jiǎn)介：這是一個(gè)用vhdl硬件描述語(yǔ)言實(shí)現(xiàn)的乘法器而不是多路選擇器

  標(biāo)簽： vhdl 硬件描述語(yǔ)言 乘法器 多路

  上傳時(shí)間： 2013-12-31

  上傳用戶：songyue1991

• 用verilog hdl硬件描述語(yǔ)言實(shí)現(xiàn)多人搶答器功能免費(fèi)下載

  資源簡(jiǎn)介：用verilog hdl硬件描述語(yǔ)言實(shí)現(xiàn)多人搶答器功能，有計(jì)時(shí)，計(jì)分，報(bào)警等功能。

  標(biāo)簽： verilog hdl 硬件描述語(yǔ)言 搶答器

  上傳時(shí)間： 2015-11-25

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• VHDl硬件描述語(yǔ)言實(shí)現(xiàn)單片機(jī)與cpld通信免費(fèi)下載

  資源簡(jiǎn)介：VHDl硬件描述語(yǔ)言實(shí)現(xiàn)單片機(jī)與cpld通信

  標(biāo)簽： VHDl cpld 硬件描述語(yǔ)言 單片機(jī)

  上傳時(shí)間： 2015-12-11

  上傳用戶：Thuan

• 使用verilog 硬件描述語(yǔ)言實(shí)現(xiàn)了spi總線協(xié)議免費(fèi)下載

  資源簡(jiǎn)介：使用verilog 硬件描述語(yǔ)言實(shí)現(xiàn)了spi總線協(xié)議

  標(biāo)簽： verilog spi 硬件描述語(yǔ)言 總線協(xié)議

  上傳時(shí)間： 2013-12-17

  上傳用戶：妄想演繹師

• 使用Verilog硬件描述語(yǔ)言完成了一個(gè)異步FIFO的設(shè)計(jì)免費(fèi)下載

  資源簡(jiǎn)介：使用Verilog硬件描述語(yǔ)言完成了一個(gè)異步FIFO的設(shè)計(jì)，供相關(guān)硬件開(kāi)發(fā)人員參考。

  標(biāo)簽： Verilog FIFO 硬件描述語(yǔ)言

  上傳時(shí)間： 2013-12-31

  上傳用戶：a673761058

• 用 硬件描述語(yǔ)言實(shí)現(xiàn)脈寬調(diào)制 VHDL 例子免費(fèi)下載

  資源簡(jiǎn)介：用 硬件描述語(yǔ)言實(shí)現(xiàn)脈寬調(diào)制 VHDL 例子

  標(biāo)簽： VHDL 硬件描述語(yǔ)言 脈寬調(diào)制

  上傳時(shí)間： 2014-08-27

  上傳用戶：leehom61

• ST7920的繁體字和圖片現(xiàn)實(shí)測(cè)試程序免費(fèi)下載

  資源簡(jiǎn)介：ST7920的繁體字和圖片現(xiàn)實(shí)測(cè)試程序，采用并行8位傳輸 單片機(jī)采用80C51

  標(biāo)簽： 7920 ST 繁體 測(cè)試程序

  上傳時(shí)間： 2014-01-23

  上傳用戶：yuchunhai1990

• 可以自由開(kāi)發(fā)的MIPS仿真器模型(.exe),指令執(zhí)行動(dòng)畫(huà)顯示.通過(guò)修改graphics和對(duì)應(yīng)的元件和互聯(lián)文件(.dit)可以自己畫(huà)流水線,其中.dit文件使用簡(jiǎn)單的硬件描述語(yǔ)言編寫.而mipsit是免費(fèi)下載

  資源簡(jiǎn)介：可以自由開(kāi)發(fā)的MIPS仿真器模型(.exe),指令執(zhí)行動(dòng)畫(huà)顯示.通過(guò)修改graphics和對(duì)應(yīng)的元件和互聯(lián)文件(.dit)可以自己畫(huà)流水線,其中.dit文件使用簡(jiǎn)單的硬件描述語(yǔ)言編寫.而mipsit是對(duì)應(yīng)的軟件開(kāi)發(fā)環(huán)境,為自己設(shè)計(jì)的流水線編程.學(xué)習(xí)體系結(jié)構(gòu)的好東西

  標(biāo)簽： dit graphics mipsit MIPS

  上傳時(shí)間： 2017-05-04

  上傳用戶：宋桃子

• 介紹vhdl硬件描述語(yǔ)言的特點(diǎn)及設(shè)計(jì)思想免費(fèi)下載

  資源簡(jiǎn)介：介紹vhdl硬件描述語(yǔ)言的特點(diǎn)及設(shè)計(jì)思想，運(yùn)用vhdl硬件描述語(yǔ)言實(shí)現(xiàn)計(jì)算機(jī)原理實(shí)驗(yàn)中RAM存儲(chǔ)器的設(shè)計(jì)方法，重點(diǎn)描述了對(duì)傳統(tǒng)計(jì)算機(jī)組成原理實(shí)驗(yàn)中移植到基于CPLD平臺(tái)的思想

  標(biāo)簽： vhdl 硬件描述語(yǔ)言 設(shè)計(jì)思想

  上傳時(shí)間： 2015-08-21

  上傳用戶：lvzhr

• UART通信協(xié)議的硬件描述語(yǔ)言代碼免費(fèi)下載

  資源簡(jiǎn)介：UART通信協(xié)議的硬件描述語(yǔ)言代碼，用與FPGA的總線接口開(kāi)發(fā)

  標(biāo)簽： UART 通信協(xié)議 硬件描述語(yǔ)言 代碼

  上傳時(shí)間： 2017-05-23

  上傳用戶：nairui21

• 利用EDA硬件描述語(yǔ)言來(lái)實(shí)現(xiàn)dds功能免費(fèi)下載

  資源簡(jiǎn)介：利用EDA硬件描述語(yǔ)言來(lái)實(shí)現(xiàn)dds功能，利用VC++6.0實(shí)現(xiàn)sinx,cosx數(shù)據(jù)的采集，用quart2軟件為載體實(shí)現(xiàn)

  標(biāo)簽： EDA dds 硬件描述語(yǔ)言

  上傳時(shí)間： 2014-01-18

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• :傳統(tǒng)的交通燈控制器多數(shù)由單片機(jī)或PLC來(lái)實(shí)現(xiàn),文中介紹了基于VHDL硬件描述語(yǔ)言進(jìn)行交通燈控制 器設(shè)計(jì)的一般思路和方法。選擇XIL INX公司低功耗、低成本、高性能的FPGA芯片,采用ISE5.免費(fèi)下載

  資源簡(jiǎn)介：:傳統(tǒng)的交通燈控制器多數(shù)由單片機(jī)或PLC來(lái)實(shí)現(xiàn),文中介紹了基于VHDL硬件描述語(yǔ)言進(jìn)行交通燈控制 器設(shè)計(jì)的一般思路和方法。選擇XIL INX公司低功耗、低成本、高性能的FPGA芯片,采用ISE5. X和MODELSIM SE 6. 0開(kāi)發(fā)工具進(jìn)行了程序的編譯和功能仿真。最后給出了交...

  標(biāo)簽： FPGA VHDL PLC INX

  上傳時(shí)間： 2013-12-20

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• 利用VHDL 語(yǔ)言設(shè)計(jì)出租車計(jì)費(fèi)系統(tǒng), 使其實(shí)現(xiàn)計(jì)費(fèi)以及預(yù)置和模擬汽車啟動(dòng)、停止、暫停等功能, 并設(shè)計(jì)動(dòng)態(tài)掃描電路顯示車費(fèi)數(shù)目, 突出了其作為硬件描述語(yǔ)言的良好的可讀性、可移植性和易理解等優(yōu)點(diǎn)。此程序免費(fèi)下載

  資源簡(jiǎn)介：利用VHDL 語(yǔ)言設(shè)計(jì)出租車計(jì)費(fèi)系統(tǒng), 使其實(shí)現(xiàn)計(jì)費(fèi)以及預(yù)置和模擬汽車啟動(dòng)、停止、暫停等功能, 并設(shè)計(jì)動(dòng)態(tài)掃描電路顯示車費(fèi)數(shù)目, 突出了其作為硬件描述語(yǔ)言的良好的可讀性、可移植性和易理解等優(yōu)點(diǎn)。此程序通過(guò)下載到特定芯片后, 可應(yīng)用于實(shí)際的出租車計(jì)費(fèi)系統(tǒng)...

  標(biāo)簽： VHDL 語(yǔ)言 出租車計(jì)費(fèi)系統(tǒng) 計(jì)費(fèi)

  上傳時(shí)間： 2017-05-22

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• SPI總線硬件描述語(yǔ)言Verilog下的實(shí)現(xiàn)免費(fèi)下載

  資源簡(jiǎn)介：SPI總線硬件描述語(yǔ)言Verilog下的實(shí)現(xiàn)，含主模式和從模式的實(shí)現(xiàn)，經(jīng)過(guò)仿真驗(yàn)證，可作為一個(gè)單獨(dú)的模塊使用

  標(biāo)簽： Verilog SPI 總線 下的實(shí)現(xiàn)

  上傳時(shí)間： 2014-01-21

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• 本文介紹了樂(lè)曲演奏電路的設(shè)計(jì)與實(shí)現(xiàn)中涉及的CPLD／FPGA可編程邏輯控件,開(kāi)發(fā)環(huán)境MAX+PLUSⅡ,硬件描述語(yǔ)言HDL以及介紹了在MAX+PLUSⅡ的EDA 軟件平臺(tái)上, 一種基于FPGA 的樂(lè)曲免費(fèi)下載

  資源簡(jiǎn)介：本文介紹了樂(lè)曲演奏電路的設(shè)計(jì)與實(shí)現(xiàn)中涉及的CPLD／FPGA可編程邏輯控件,開(kāi)發(fā)環(huán)境MAX+PLUSⅡ,硬件描述語(yǔ)言HDL以及介紹了在MAX+PLUSⅡ的EDA 軟件平臺(tái)上, 一種基于FPGA 的樂(lè)曲發(fā)生器的設(shè)計(jì)方法, 并給出了設(shè)計(jì)的頂層電路圖和底層模塊的VHDL（或AHDL）源程序。該設(shè)...

  標(biāo)簽： FPGA PLUS MAX CPLD

  上傳時(shí)間： 2014-02-01

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• 基才DSP、dds和ARM的雷達(dá)中頻信號(hào)模擬器設(shè)計(jì)與實(shí)現(xiàn)免費(fèi)下載

  資源簡(jiǎn)介：基才DSP、dds和ARM的雷達(dá)中頻信號(hào)模擬器設(shè)計(jì)與實(shí)現(xiàn)

  標(biāo)簽： DSP dds ARM 雷達(dá)

  上傳時(shí)間： 2013-06-03

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• 用FPGA可編程器件和VHDL硬件描述語(yǔ)言來(lái)實(shí)現(xiàn)Flash編程器免費(fèi)下載

  資源簡(jiǎn)介：用 ＦＰＧＡ 可編程器件和 ＶＨＤＬ 硬件描述語(yǔ)言來(lái)實(shí)現(xiàn) Ｆｌａｓｈ 編程器

  標(biāo)簽： Flash FPGA VHDL 可編程器件

  上傳時(shí)間： 2013-08-10

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• 程序主要用硬件描述語(yǔ)言（VHDL）實(shí)現(xiàn)： 單片機(jī)與FPGA接口通信的問(wèn)題免費(fèi)下載

  資源簡(jiǎn)介：程序主要用硬件描述語(yǔ)言（VHDL）實(shí)現(xiàn)： 單片機(jī)與FPGA接口通信的問(wèn)題

  標(biāo)簽： VHDL FPGA 程序 硬件描述語(yǔ)言

  上傳時(shí)間： 2015-04-06

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• yon用硬件描述語(yǔ)言寫的曼徹斯特編解碼,并在Xilinx CPLD上的實(shí)現(xiàn),內(nèi)容齊全,是學(xué)習(xí)的好資料免費(fèi)下載

  資源簡(jiǎn)介：yon用硬件描述語(yǔ)言寫的曼徹斯特編解碼,并在Xilinx CPLD上的實(shí)現(xiàn),內(nèi)容齊全,是學(xué)習(xí)的好資料

  標(biāo)簽： Xilinx CPLD yon 硬件描述語(yǔ)言

  上傳時(shí)間： 2013-12-02

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